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電子產(chǎn)品設(shè)計階段的成本控制
本文從幾個角度來探討電子產(chǎn)品開發(fā)過程中的開發(fā)成本控制方法。
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開關(guān)電源的PCB設(shè)計規(guī)范
在任何開關(guān)電源設(shè)計中，PCB板的物理設(shè)計都是最后一個環(huán)節(jié)，如果設(shè)計方法不當(dāng)，PCB可能會輻射過多的電磁干擾，造成電源工作不穩(wěn)定，文中針對各個步驟中所需注意的事項進(jìn)行分析。
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基于TRAC器件的鎖相環(huán)設(shè)計研究
以TRAC020LH完全可重配置模擬器件和TRAC開發(fā)軟件為基礎(chǔ)，設(shè)計模擬鎖相環(huán)；給出仿真結(jié)果和利用PIC單片機(jī)對器件進(jìn)行配置的應(yīng)用電路。
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基于Nios平臺的光信號采集片上系統(tǒng)設(shè)計
介紹基于Altera Excalibur平臺的光信號采集片上系統(tǒng)的設(shè)計，詳細(xì)地分析片上系統(tǒng)各個組成部分的工作原理。
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PicoBlaze處理器IP Core的原理與應(yīng)用
詳細(xì)分析8位微處理器IP core PicoBlaze的結(jié)構(gòu)、原理與設(shè)計方案。
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FPGA芯片APA150及其應(yīng)用
文章介紹了APA150的主要特點(diǎn)、內(nèi)部結(jié)構(gòu)、主要性能參數(shù)，給出了APA150在通信系統(tǒng)設(shè)計中的應(yīng)用實例。
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基于FPGA的快速傅立葉變換
在對FFT（快速傅立葉變換）算法進(jìn)行研究的基礎(chǔ)上，描述了用FPGA實現(xiàn)FFT的方法，并對其中的整體結(jié)構(gòu)、蝶形單元及性能等進(jìn)行了分析。
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基于FPGA的直接數(shù)字頻率合成技術(shù)設(shè)計
介紹了利用現(xiàn)場可編程邏輯門陣列FPGA實現(xiàn)直接數(shù)字頻率合成（DDS）的原理、電路結(jié)構(gòu)和優(yōu)化方法。
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Xilinx Foundation F3.1的結(jié)構(gòu)及設(shè)計流程
介紹了Xilinx Foundation F3.1可編程器件開發(fā)工具軟件的組成和功能，同時介紹了該軟件工具中設(shè)計入口工具和設(shè)計實現(xiàn)工具的主要功能和使用特點(diǎn)。
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在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換
采用數(shù)字化技術(shù)、在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換，并且在1片可編程邏輯器件中實現(xiàn)。
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用XC9572實現(xiàn)HDB3編解碼設(shè)計
介紹了HDB3編解碼的原理和方法，給出了用CPLD實現(xiàn)E1信號HDB3編解碼的方法，同時給出了它的實現(xiàn)原理圖，最后給出了XILINX的XC9500系列可編程邏輯器件的開發(fā)流程。
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在系統(tǒng)可編程模擬器件ispPAC10及其應(yīng)用
介紹lattice半導(dǎo)體公司推出的可編程模擬器件ispPAC10內(nèi)部結(jié)構(gòu)及設(shè)計應(yīng)用。
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VHDL中Loop動態(tài)條件的可綜合轉(zhuǎn)化
論述VHDL中Loop語句動態(tài)表達(dá)式的可綜合性問題，提出三種解決方法：直接代入法、邊界擴(kuò)充法和計數(shù)器法，并對比這三類方法的適用性。
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異步FIFO結(jié)構(gòu)及FPGA設(shè)計
首先介紹異步FIFO的概念、應(yīng)用及其結(jié)構(gòu)，然后分析實現(xiàn)異步FIFO的難點(diǎn)問題及其解決辦法；在傳統(tǒng)設(shè)計的基礎(chǔ)上提出一種新穎的電路結(jié)構(gòu)并對其進(jìn)行綜合仿真和FPGA實現(xiàn)。
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3-DES算法的FPGA高速實現(xiàn)
介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實現(xiàn)3-DES算法的設(shè)計要點(diǎn)及關(guān)鍵部分的設(shè)計。
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