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SMIC推出基于CPF的CADENCE低功耗數(shù)字參考流程
SMIC宣布SMIC正推出一種基于通用功率格式（CPF）的90納米低功耗數(shù)字參考流程，以及兼容CPF的庫。SMIC還宣布其已經(jīng)加盟Power Forward Initiative（PFI）。這種新流程使用了由SMIC開發(fā)的知識產(chǎn)權(quán)，并應用了Cadence設計
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Actel推出具有4 mm封裝低功耗FPGA AGL030
AGL030 IGLOO FPGA封裝為4 x 4-mm，球間距為0.4-mm。30,000門閃存技術(shù)的器件待機時靜態(tài)電流的典型值僅僅為4 μA，并且在上電時不需要裝載程序。該芯片具有1 Kbit的閃存，66個用戶I/O, 大于相當于192個宏單元的特性。
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Actel推出適用于便攜式產(chǎn)品的低功耗FPGA系列
IGLOO系列的靜態(tài)功耗為5uW，可延長便攜式應用的電池壽命，滿足了便攜式應用對功耗的嚴苛要求。Actel公司宣布推出最低功耗現(xiàn)場可編程門陣列(FPGA)--IGLOO系列，滿足便攜式應用對功耗的嚴苛要求。這個以Flash為基礎的產(chǎn)
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Altera發(fā)布低成本低功耗CPLD EPM240/570
Altera公司宣布擴展MAX II器件系列，以滿足不斷發(fā)展的便攜式應用市場的需求。MAX II器件采用了新的超小外形封裝和新型關(guān)斷功能，據(jù)稱是業(yè)界成本最低的器件，手持式應用設計人員使用該器件后，成本和功耗僅是競爭產(chǎn)品
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Actel退出適合太空應用的低功耗FPGA RTAX
耐輻射RTAX-SL FPGA系列是現(xiàn)有器件系列中的一款低功耗系列，其目標市場定位于高可靠性太空飛行設計。在最差情況下，與標準器件相比，該器件可以提供大約低50%的待機電流。FPGA的邏輯門密度擴展到250,000到40億等效系
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QuickLogic最新FPGA具低功耗
QuickLogic公司發(fā)布最新的FPGA產(chǎn)品——PolarPro系列。PolarPro器件具有費效比高、功耗超低等優(yōu)點，并提供小型化封裝，支持便攜應用所必須的節(jié)能策略，同時保持了傳統(tǒng)FPGA器件靈活配置和開發(fā)迅速的優(yōu)勢。PolarPro系列
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嵌入式處理器的低功耗的實現(xiàn)方案
一直以來，嵌入式處理器的低功耗是通過使用一些低功耗的空閑或睡眠模式來實現(xiàn)的。現(xiàn)在，嵌入式處理器要承擔更復雜的工作，需要更高的性能。新的應用程序（如音頻和視頻播放以及游戲等）一般運行時間
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Altera發(fā)布具有安全特性的低功耗新系列Cyclone III LS FPGA
繼續(xù)擴大在低功耗解決方案上的領(lǐng)先優(yōu)勢，Altera公司今天發(fā)布了具有安全特性的低功耗新系列FPGA。新的Altera Cyclone III LS FPGA在單位面積電路板上具有密度最大的邏輯、存儲器和DSP資源。這些器件是功耗最低的FPGA，
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低功耗嵌入式系統(tǒng)的設計考量：一般設計考量
低功耗電池供電嵌入式應用的設計考量1. 硬件考量：a. 電池類型：在嵌入式應用中主要有以下類型的電池：i. )標準堿性電池iii. )可充電電池: 可充電堿性電池，鋰離子電池iii.
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CEVA推出深層神經(jīng)網(wǎng)絡框架 加快低功耗嵌入式系統(tǒng)中機器學習技術(shù)的應用
全球領(lǐng)先的蜂窩通信、多媒體和連接性DSP IP平臺授權(quán)廠商CEVA公司宣布推出實時神經(jīng)網(wǎng)絡軟件框架CEVA 深層神經(jīng)網(wǎng)絡（CEVA Deep Neural Network， CDNN），以簡化低功耗嵌入式
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低功耗待測器件實現(xiàn)高精度低電流測量兩種方式
概述 由于當今的重點是綠色出行和打造移動設備和物聯(lián)網(wǎng)設備，因此實現(xiàn)集成電路和電子組件功耗最小化已成為器件制造商的夢想。功耗最低意味著實現(xiàn)所有集成電路和電子組件的電流消耗最低。為了對這
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IDT推出為便攜式消費應用優(yōu)化的VersaClock可編程低功耗計時器件
IDT公司（Integrated Device Technology, Inc.）日前宣布，推出 IDT VersaClock 計時系列器件最新產(chǎn)品，VersaClock 低功耗器件是一種可編程時鐘生成器，專為電池供電的消費應用設計，包括智能手機、個人導航設備、MP
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保證MCU低功耗 這五點很重要
低功耗是MCU的一項非常重要的指標，比如某些可穿戴的設備，其攜帶的電量有限，如果整個電路消耗的電量特別大的話，就會經(jīng)常出現(xiàn)電量不足的情況，影響用戶體驗。 平時我們在
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采用統(tǒng)一功率格式的SoC的低功耗設計方案
為了幫助日益壯大的設計隊伍，EDA行業(yè)必須為設計人員提供能夠使整個流程順利執(zhí)行的自動化解決方案。這些解決方案必須對功率進行優(yōu)化，同時滿足所有其它的設計和市場要求，包括速度、成本和IC制造良率。 功率問題
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低功耗MCU設計理念
MCU功耗來自何處 在開始討論低功耗MCU設計前，必須先探討MCU功耗的來源，其主要由靜態(tài)功耗及運行功耗兩部分組成?？紤]實際的應用，最后決定系統(tǒng)功耗性能指針則必須計算平均功耗。 運行功耗 現(xiàn)代 M
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嵌入式低功耗開發(fā)
不知從什么時候開始，隨便做個什么電子產(chǎn)品，至少是電池供電的，都要求低功耗特性了。好在市面上隨便什么芯片都敢在自己的數(shù)據(jù)手冊的第一頁赫然寫著低功耗。究竟怎樣算低功
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解析FPGA低功耗設計
在項目設計初期，基于硬件電源模塊的設計考慮，對FPGA設計中的功耗估計是必不可少的。筆者經(jīng)歷過一個項目，整個系統(tǒng)的功耗達到了100w,而單片F(xiàn)PGA的功耗估計得到為20w左右，有點過高了，功耗過高則會造成發(fā)熱量增大，
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atmega48的低功耗設計方案
本文主要介紹了atmega48單片機的特性，提出了其低功耗設計的一般方法，并以定時控制系統(tǒng)的設計為例，具體說明atmega48的低功耗設計方案。 隨著微電子技術(shù)和計算機技術(shù)的發(fā)展，尤其是微機在各個領(lǐng)域的
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基于ARM處理器的低功耗的語音去噪系統(tǒng)設計
譜減法作為一種很有效的語音信號處理手段，廣泛應用于現(xiàn)代語音增強系統(tǒng)中。針對低功耗設計的要求，本系統(tǒng)采用功耗低且功能強大的ARM芯片，用C語言編程將算法成功移植到ARM系統(tǒng)中，該系統(tǒng)功耗低，并有
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基于嵌入式系統(tǒng)的低功耗軟件特征及其功能實現(xiàn)
引言低功耗是嵌入式電子產(chǎn)品必須具備的一個關(guān)鍵特性，在硬件技術(shù)飛速發(fā)展和日益完善的時候，已經(jīng)很難有功耗方面的突破了。所以現(xiàn)在降低產(chǎn)品功耗主要是依靠軟件來處理，必須
