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基于FPGA的正碼速調(diào)整的設(shè)計(jì)與實(shí)現(xiàn)
摘要：本文提出了基于FPGA正碼速調(diào)整的設(shè)計(jì)方案，采用格雷碼對(duì)地址編碼的異步FIFO設(shè)計(jì)，并利用MAXPLUSⅡ進(jìn)行編譯和仿真。結(jié)果表明，設(shè)計(jì)方法切實(shí)可行。 1 引言 在時(shí)分制數(shù)字通信系統(tǒng)中，為了擴(kuò)大傳輸容量和提高傳輸效
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