前言 在鎖相環(huán)PLL、DLL和時鐘數(shù)據(jù)恢復電路CDR等電路的應用中,人們普遍要求輸出時鐘信號有50%的占空比,以便在時鐘上升及下降沿都能夠采樣數(shù)據(jù),最大限度地提高數(shù)據(jù)傳輸
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