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采用編譯增強(qiáng)技術(shù)，提高高密度FPGA設(shè)計(jì)工作效率
現(xiàn)場(chǎng)可編程門陣列（FPGA）體系創(chuàng)新以及向90nm工藝技術(shù)的過(guò)渡顯著提高了FPGA的密度和性能。FPGA設(shè)計(jì)人員不僅需要更高的邏輯密度和更快的性能表現(xiàn)，還要求具有嵌入式處理器、數(shù)字信號(hào)處理（DSP）模塊以及其他硬件IP結(jié)構(gòu)等復(fù)雜的器件功能。但是，由于FPGA設(shè)計(jì)規(guī)模越來(lái)越大、越來(lái)越復(fù)雜，為了能夠抓住稍縱即逝的市場(chǎng)機(jī)會(huì)，設(shè)計(jì)人員必需盡快完成其設(shè)計(jì)。
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