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    模擬
    2012-06-24
    電路 引腳 IC BSP
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  • 估算LC電路的Q值的方法

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  • 計(jì)算接地環(huán)路電感和算出阻尼雙極點(diǎn)的上升時(shí)間的方法

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    大多數(shù)示波器探頭上都套有一個(gè)可拆卸的塑料抓鉤。將這個(gè)塑料夾去掉,就會(huì)露出探頭的芯片管。如果必要,可以將固定接地引線的裝置拆開,裸露出低電感的接地金屬護(hù)套。這個(gè)金屬護(hù)套,或者說接地環(huán)套,一直延伸到探頭的

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    開關(guān)量輸入輸出通道和模擬量輸入輸出通道,都是干擾竄入的渠道,要切斷這條渠道,就要去掉對象與輸入輸出通道之間的公共地線,實(shí)現(xiàn)彼此電隔離以抑制干擾脈沖。最常見的隔離器件是光電耦合器,其內(nèi)部結(jié)構(gòu)見下圖 : 具

  • 時(shí)鐘相位調(diào)整的電路簡介

    圖3.23所示的電路,是一個(gè)16進(jìn)制的反相器,用于產(chǎn)生30~160NS的延遲。每一級(jí)的延遲時(shí)間是5~35NS,具體數(shù)值由可變電阻的值決定。每一級(jí)的延遲時(shí)間不應(yīng)該超過時(shí)鐘周期的12%,以保重穩(wěn)定工作。通過調(diào)整延遲級(jí)數(shù)(2或4)并

  • 鎖相環(huán)的時(shí)間調(diào)整分析

    圖3.24給出了CADILLAC時(shí)鐘相位調(diào)整電路的框圖。對于大規(guī)模生產(chǎn)測試,可能值得構(gòu)造這樣的電路。對于普通的實(shí)驗(yàn)測試,則太麻煩了。電路將總線時(shí)鐘進(jìn)行N分頻,然后通過一個(gè)-頻率比較器把它與一個(gè)同樣經(jīng)過N分頻的本地振蕩

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