由于ZYNQ架構(gòu)和常用接口IP核經(jīng)常出現(xiàn) AXI協(xié)議，賽靈思的協(xié)議手冊講解時序比較分散。所以筆者收藏AXI協(xié)議的幾種時序，方便編程。

1》AXI_LITE協(xié)議：

( 1) 讀地址通道， 包含ARVALID， ARADDR， ARREADY信號;

( 2) 讀數(shù)據(jù)通道， 包含RVALID， RDATA， RREADY， RRESP信號;

( 3) 寫地址通道， 包含AWVALID， AWADDR， AWREADY信號;

( 4) 寫數(shù)據(jù)通道， 包含WVALID， WDATA， WSTRB， WREADY信號;

( 5) 寫應(yīng)答通道， 包含BVALID， BRESP， BREADY信號;( 6) 系統(tǒng)通道， 包含： ACLK， ARESETN信號。

AXI4總線和AXI4-Lite總線的信號也有他的命名特點：讀地址信號都是以AR開頭( A： address; R： read)寫地址信號都是以AW開頭( A： address; W： write)讀數(shù)據(jù)信號都是以R開頭( R： read)寫數(shù)據(jù)信號都是以W開頭( W： write)

XI4總線和AXI4-Lite總線的信號也有他的命名特點：讀地址信號都是以AR開頭( A： address; R： read)寫地址信號都是以AW開頭( A： address; W： write)讀數(shù)據(jù)信號都是以R開頭( R： read)寫數(shù)據(jù)信號都是以W開頭( W： write)

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AXI_LITE讀時序：

AXI_LITE：寫時序

AXI總線協(xié)議的幾種時序介紹

2》AXI_STREAM：

AXI4-Stream總線的組成有：

( 1) ACLK信號： 總線時鐘， 上升沿有效;

( 2) ARESETN信號： 總線復(fù)位， 低電平有效

( 3) TREADY信號： 從機告訴主機做好傳輸準備;

( 4) TDATA信號： 數(shù)據(jù)， 可選寬度32，64，128，256bit

( 5) TSTRB信號： 每一bit對應(yīng)TDATA的一個有效字節(jié)， 寬度為TDATA/8

( 6) TLAST信號： 主機告訴從機該次傳輸為突發(fā)傳輸?shù)慕Y(jié)尾;

( 7) TVALID信號： 主機告訴從機數(shù)據(jù)本次傳輸有效;

( 8) TUSER信號 ： 用戶定義信號， 寬度為128bit。