市場上涌現(xiàn)各種價(jià)格親民的經(jīng)濟(jì)型微控制器,助力新一代開發(fā)者創(chuàng)造令人興奮的新型嵌入式應(yīng)用。如今的開發(fā)工具非常好用,軟硬件均呈現(xiàn)模塊化趨勢(shì),插接安裝簡單容易,使得產(chǎn)品
嵌入式系統(tǒng)可以對(duì)各種數(shù)據(jù)信息進(jìn)行快速計(jì)算、分析、輸出,即完成對(duì)數(shù)據(jù)的處理,但很多時(shí)候就需要用戶“告訴”系統(tǒng)如何執(zhí)行下一步動(dòng)作,這時(shí),就需要使用輸入設(shè)備
1、與發(fā)光二極管串聯(lián)的電阻(排阻)的計(jì)算和選取,一般發(fā)光二極管的正常發(fā)光的電流是3~10mA,在發(fā)光二極管上產(chǎn)生的壓降是1.7V(軌管) R=(5-1.7)/3~10 (k)2、單片機(jī)TTL電平 高電
在電子電路設(shè)計(jì)中,干擾的存在讓設(shè)計(jì)者們苦不堪言,干擾會(huì)導(dǎo)致電路發(fā)生異常,甚至?xí)?dǎo)致最終的產(chǎn)品無法正常使用。如何巧妙地減少甚至避免干擾始終是設(shè)計(jì)者們關(guān)心的重點(diǎn),其
信號(hào)的邏輯電平經(jīng)歷了從單端信號(hào)到差分信號(hào)、從低速信號(hào)到高速信號(hào)的發(fā)展過程。最基本的單端信號(hào)邏輯電平為CMOS、TTL,在此基礎(chǔ)上隨著電壓擺幅的降低,出現(xiàn)LVCMOS、LVTTL等
在工業(yè)控制、智能儀表中都普遍采用了單片機(jī),單片機(jī)抗干擾措施提到重要議事日程上來。單片機(jī)抗干擾措施不解決,其它工作也是白費(fèi)勁。要解決單片機(jī)干擾問題,必須先找出干擾
引言現(xiàn)場可編程門陣列(FPGA)芯片在許多領(lǐng)域均有廣泛的應(yīng)用,尤其是在無線通信領(lǐng)域。FPGA具有極強(qiáng)的實(shí)時(shí)性和并行處理能力,這使其對(duì)信號(hào)進(jìn)行實(shí)時(shí)處理成為可能。FPGA內(nèi)部一般
了解采集模擬信號(hào)的基礎(chǔ)知識(shí),包含帶寬、幅值誤差、上升時(shí)間、采樣率、奈奎斯特定理、混疊與分辨率等。 本教程是儀器基礎(chǔ)教程系列的一部分。1. 什么是數(shù)字化儀?科學(xué)家和工程
對(duì)于EMI的控制滲透在電路設(shè)計(jì)的每一個(gè)角落當(dāng)中,在IC芯片的封裝當(dāng)中也有針對(duì)EMI進(jìn)行預(yù)防的方法,本文就將為大家介紹封裝特征在EMI控制當(dāng)中的作用。IC 封裝通常包括硅基芯片
隨著國民經(jīng)濟(jì)的快速發(fā)展,電能需求日益提升,電網(wǎng)的安全運(yùn)越發(fā)重要。靜止無功功率發(fā)生裝置 SVG設(shè)備可平衡三相負(fù)荷,抑制電網(wǎng)諧波,提高功率因素,大大提高電網(wǎng)的電能質(zhì)量,保障設(shè)備運(yùn)行安全。
什么是仿真?我們舉一個(gè)汽車設(shè)計(jì)的例子來說明一下吧。大家一定在影視劇或電視廣告中看過這樣的鏡頭:在一個(gè)大大的廠房里,一輛嶄新的小汽車正在以很高的速度撞向一面厚厚的水
嵌入式軟件開發(fā)流程參照嵌入式軟件的開發(fā)流程。第一步:工程建立和配置。第二步:編輯源文件。第三步:工程編譯和鏈接。第四步:軟件的調(diào)試。第五步:執(zhí)行文件的固化。在整
FPGA(Field-Program mable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制
在單片機(jī)應(yīng)用開發(fā)中,代碼的使用效率問題、單片機(jī)抗干擾性和可靠性等問題仍困擾著.現(xiàn)歸納出單片機(jī)開發(fā)中應(yīng)掌握的幾個(gè)基本技巧.1、如何減少程序中的bug.對(duì)于如何減少程序的bu
在工業(yè)控制、智能儀表中都普遍采用了單片機(jī),單片機(jī)抗干擾措施提到重要議事日程上來。單片機(jī)抗干擾措施不解決,其它工作也是白費(fèi)勁。要解決單片機(jī)干擾問題,必須先找出干擾
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