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目標(biāo)設(shè)計平臺讓FPGA的使用更加簡單
關(guān)鍵字: FPGA 目標(biāo)設(shè)計平臺 Virtex-6 LTE TD-SCDMA 如今，差異化、創(chuàng)新和靈活性成為電子系統(tǒng)設(shè)計取得成功的關(guān)鍵。而FPGA在片上系統(tǒng)級硬件設(shè)計、實施以及可編程方面的優(yōu)勢，使其成為越來越多應(yīng)用采用的器件。目前
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賽靈思亞太聯(lián)盟計劃成員開展目標(biāo)設(shè)計平臺合作
日前，賽靈思公司（Xilinx, Inc.)）聯(lián)盟計劃成員（APAC Xilinx Alliance Program Members），是賽靈思作為 FPGA行業(yè)領(lǐng)導(dǎo)廠商實施目標(biāo)設(shè)計平臺戰(zhàn)略的關(guān)鍵。賽靈思目標(biāo)設(shè)計平臺戰(zhàn)略致力于幫助客戶縮短在應(yīng)用基礎(chǔ)架構(gòu)上
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賽靈思、中電網(wǎng)及依元素科技強強聯(lián)手 推動“信息技術(shù)緊缺人才培養(yǎng)工程”
賽靈思公司日前宣布聯(lián)手中國電子行業(yè)領(lǐng)先的培訓(xùn)機構(gòu)中電網(wǎng) (ChinaECNet)及賽靈思公司大中華授權(quán)培訓(xùn)公司依元素科技公司(E-elements)， 共同推動中國國家級“國家信息技術(shù)緊缺人才培養(yǎng)工程”的“電子工程與集成電路技
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賽靈思亞太聯(lián)盟計劃成員開展目標(biāo)設(shè)計平臺合作
賽靈思公司（Xilinx）聯(lián)盟計劃成員（APAC Xilinx Alliance Program Members），是賽靈思作為 FPGA行業(yè)領(lǐng)導(dǎo)廠商實施目標(biāo)設(shè)計平臺戰(zhàn)略的關(guān)鍵。賽靈思目標(biāo)設(shè)計平臺戰(zhàn)略致力于幫助客戶縮短在應(yīng)用基礎(chǔ)架構(gòu)上花費的時間，而
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賽靈思上調(diào)第二財季營收預(yù)期
北京時間周三晚間消息，半導(dǎo)體部件制造商賽靈思公司(XLNX)上調(diào)了第二財季營收預(yù)期。 該公司目前預(yù)計第二季營收環(huán)比增長10%，增幅大于此前預(yù)期的2-6%。 賽靈思表示，上調(diào)營收預(yù)期的主要原因是，幾乎所有終端市場及
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廣播連接目標(biāo)設(shè)計平臺(Xilinx)
賽靈思公司（Xilinx）在2009 年國際廣播電視博覽會 (IBC2009) 上展示了串行連接領(lǐng)域的最新開發(fā)成果，這些技術(shù)可顯著降低串行數(shù)字接口的成本和功耗，并有助于全新 DisplayPort 和 Ethernet AVB協(xié)議的快速采用。賽靈思
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大幅縮短研發(fā)周期，賽靈思目標(biāo)設(shè)計平臺方案獲行業(yè)認(rèn)可
全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. ）近日宣布，在8月28日成都舉辦的“2009中國FPGA產(chǎn)業(yè)發(fā)展論壇”上，《中國電子報》把“2009 FPGA最佳產(chǎn)品獎”授予賽靈思目標(biāo)設(shè)計平臺(Target Design Platfo
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賽靈思：降低電子設(shè)計成本 主推目標(biāo)設(shè)計平臺
今年3月，美國專利商標(biāo)局評選出本年度15位入選“美國發(fā)明家名人堂”的科學(xué)家，賽靈思公司共同創(chuàng)辦人、FPGA(現(xiàn)場可編程門陣列)的發(fā)明者RossFreeman赫然在列。“美國發(fā)明家名人堂”是美國專利商標(biāo)
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賽靈思Virtex-6 FPGA兼容PCI Express 2.0標(biāo)準(zhǔn)
賽靈思公司（Xilinx ）宣布其最新一代Virtex®-6 FPGA系列兼容PCI Express® 2.0標(biāo)準(zhǔn)，與前一代產(chǎn)品系列相比功耗降低50%，與競爭產(chǎn)品相比性能提高15%。在Virtex-6 FPGA中集成的第二代PCIe®模塊已經(jīng)通過了1
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聯(lián)電65納米曝良率問題 Xilinx受損
繼臺積電傳出40納米制程出現(xiàn)良率問題，聯(lián)電客戶端FPGA(Field Programmable Gate Array)芯片業(yè)者賽靈思(Xilinx)，亦傳出因65納米制程良率問題，導(dǎo)致高階產(chǎn)品Virtex-5大缺貨，且可能要到9月才能獲得解決。臺積電、聯(lián)電
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聯(lián)電65納米曝良率問題 Xilinx受損
繼臺積電傳出40納米制程出現(xiàn)良率問題，聯(lián)電客戶端FPGA(Field Programmable Gate Array)芯片業(yè)者賽靈思(Xilinx)，亦傳出因65納米制程良率問題，導(dǎo)致高階產(chǎn)品Virtex-5大缺貨，且可能要到9月才能獲得解決。臺積電、聯(lián)電
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賽靈思領(lǐng)先FPGA廠商模仿“MTK模式”
就像當(dāng)初“工業(yè)學(xué)大慶，農(nóng)業(yè)學(xué)大寨”一樣，現(xiàn)在全電子業(yè)都在學(xué)習(xí)“聯(lián)發(fā)科”模式。勝者為王，敗者為寇，聯(lián)發(fā)科Turn key方式的完勝讓所有的電子業(yè)者開始反思自己的業(yè)務(wù)模式，并對自身的業(yè)務(wù)模式進(jìn)行改革。 在這種趨勢
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