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Altera、MIPS等聯(lián)合發(fā)布MIPS-Based的FPGA軟核處理器
Altera、MIPS科技以及System Level Solutions (SLS) 日前推出了MIPS-BasedTM、FPGA優(yōu)化軟核處理器，適用于Altera FPGA以及ASIC器件。MP32處理器是MIPS兼容應用類處理器，繼承了業(yè)界規(guī)模最大的軟件開發(fā)工具以及操作系
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Altera、MIPS等聯(lián)合發(fā)布MIPS-Based的FPGA軟核處理器
Altera、MIPS等聯(lián)合發(fā)布MIPS-Based的FPGA軟核處理器
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多處理器系統(tǒng)中Nios II軟核處理器啟動方案的設計
多處理器系統(tǒng)中Nios II軟核處理器啟動方案的設計
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多處理器系統(tǒng)中Nios II軟核處理器啟動方案的設計
多處理器系統(tǒng)中Nios II軟核處理器啟動方案的設計
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ML7204和PicoBlaze軟核處理器實現(xiàn)低速話音編解碼系統(tǒng)
語音信號壓縮編碼是數(shù)字語音信號處理的主要方面，在現(xiàn)有的語音編碼中，G．729A算法在8 kb／s的碼率下取得了較好的語音質量，具有廣闊應用前景，因此提出采用PicoBlaze和ML7204實現(xiàn)G．729A語音壓縮／解壓詳細的軟硬件實現(xiàn)方案，并描述了G．729A語音編解碼器ML7204的工作原理、性能、接口，以及FPGA內嵌IP核微處理器PicoBlaze的特點和使用方法。給出硬件電路設計原理，以及各部分的具體實現(xiàn)方法和原理圖。并給出軟件流程和主要代碼。實驗結果表明，系統(tǒng)提供話音點到點的時延僅為25 ms，而語音質量平均意見MOS值達到4．2，在可懂度和清晰度等性能優(yōu)異，該系統(tǒng)設計可應用于無線移動網(wǎng)、數(shù)字多路復用系統(tǒng)和計算機通信系統(tǒng)。
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AEMB軟核處理器的SoC系統(tǒng)驗證平臺
本文基于32位微處理器AEMB設計了一款SoC系統(tǒng)驗證平臺，給出了SoC系統(tǒng)經(jīng)過FPGA綜合后的邏輯資源占用情況，以及系統(tǒng)能夠運行的最高時鐘頻率。該平臺已在臺灣友晶公司的DE2-70開發(fā)板上完成了FPGA驗證。
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AEMB軟核處理器的SoC系統(tǒng)驗證平臺
AEMB軟核處理器的SoC系統(tǒng)驗證平臺
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基于軟核處理器的二頻機抖陀螺信號處理系統(tǒng)
1 引言 激光陀螺的工作原理是Sagnac效應，與傳統(tǒng)的機械陀螺相比，激光陀螺具有精度高、耐環(huán)境性能好、動態(tài)性能好、啟動時間短、壽命長及數(shù)字式輸出等特點，是捷聯(lián)式慣性導航系統(tǒng)的理想元件。目前激光陀螺已逐漸
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基于軟核處理器的二頻機抖陀螺信號處理系統(tǒng)
基于軟核處理器的二頻機抖陀螺信號處理系統(tǒng)
海中水
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Blueshadow1002
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不愛說話
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