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多端口SDRAM控制器的設(shè)計(jì)與實(shí)現(xiàn)
0 引 言 目前，在很多視頻數(shù)據(jù)采集以及實(shí)時(shí)顯示的應(yīng)用開(kāi)發(fā)中，常需要用到存儲(chǔ)容量大、讀寫(xiě)速度快的存儲(chǔ)器。在各種存儲(chǔ)器件中，同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器SDRAM 以其速度快、容量大、價(jià)格低的特點(diǎn)而備受關(guān)注。SDRAM 的工
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基于FPGA的高速SDRAM控制器的視頻應(yīng)用
0 引言 SDRAM(同步動(dòng)態(tài)存儲(chǔ)器)是一種應(yīng)用廣泛的存儲(chǔ)器，具有容量大、數(shù)據(jù)讀寫(xiě)速度快、價(jià)格低廉等優(yōu)點(diǎn)，特別適合那些需要海量存儲(chǔ)器的應(yīng)用領(lǐng)域，例如視頻方面。 這里有一個(gè)視頻項(xiàng)目要求將非標(biāo)準(zhǔn)的ITU-R BT.
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嵌入式實(shí)時(shí)圖像處理系統(tǒng)中SDRAM控制器的實(shí)現(xiàn)
介紹一種用于嵌入式實(shí)時(shí)圖像處理系統(tǒng)的SDRAM控制器的實(shí)現(xiàn)方案。根據(jù)實(shí)時(shí)系統(tǒng)對(duì)數(shù)據(jù)傳輸速率及連續(xù)性的要求，將SDRAM配置為全頁(yè)突發(fā)操作模式，并采用異步FIFO作為FPGA與SDRAM間的數(shù)據(jù)緩沖器。為配合SDRAM的全頁(yè)操作模式，并充分利用其高速讀寫(xiě)性能，將FIFO設(shè)計(jì)為基于乒乓操作的流水線結(jié)構(gòu)，實(shí)現(xiàn)了數(shù)據(jù)的無(wú)縫緩存。將該方案用于實(shí)時(shí)紅外熱成像系統(tǒng)，經(jīng)實(shí)驗(yàn)結(jié)果表明，該SDRAM控制器執(zhí)行效率高，占用資源少，可移植性強(qiáng)。
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嵌入式實(shí)時(shí)圖像處理系統(tǒng)中SDRAM控制器的實(shí)現(xiàn)
嵌入式實(shí)時(shí)圖像處理系統(tǒng)中SDRAM控制器的實(shí)現(xiàn)
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SDRAM在任意波形發(fā)生器中的應(yīng)用
任意波形發(fā)生器在雷達(dá)、通信領(lǐng)域中發(fā)揮著重要作用,但目前任意波形發(fā)生器大多使用靜態(tài)存儲(chǔ)器。這使得在任意波形發(fā)生器工作頻率不斷提高的情況下,波形的存儲(chǔ)深度很難做得很大,從而不能精確地表達(dá)復(fù)雜信號(hào)。本文介紹的基于動(dòng)態(tài)存儲(chǔ)器(SDRAM)的設(shè)計(jì)能有效解決這一問(wèn)題,并詳細(xì)討論了一種簡(jiǎn)化SDRAM控制器的設(shè)計(jì)方法。
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片上SDRAM控制器的設(shè)計(jì)與集成
本文介紹了SDRAM 控制器IP 核的設(shè)計(jì)、電路的功能仿真、綜合以及驗(yàn)證等過(guò)程,其中重點(diǎn)討論了該控制器的接口設(shè)計(jì)以實(shí)現(xiàn)SoC的集成。
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使用Verilog實(shí)現(xiàn)基于FPGA的SDRAM控制器
介紹了SDRAM的特點(diǎn)和工作原理，提出了一種基于FPGA的SDRAM控制器的設(shè)計(jì)方法，使用該方法實(shí)現(xiàn)的控制器可非常方便地對(duì)SDRAM進(jìn)行控制。
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