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VDMOS

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    模擬
    2009-11-25
    電容 CIS BSP VDMOS
  • 一種減少VDMOS寄生電容的新結構

    分析影響VDMOS開關特性的各部分電容結構及參數,為了減少寄生電容,提高開關速度,在此提出一種減少VDMOS寄生電容的新型結構。該方法是部分去除傳統(tǒng)VDMOS的neck區(qū)多晶硅條,并利用多晶硅作掩模注入P型區(qū),改變VDMOS柵下耗盡區(qū)形狀,減小寄生電容。在此增加了neck區(qū)寬度,并增加了P阱注入。利用TCAD工具模擬,結果表明:這種新型結構與傳統(tǒng)VDMOS相比,能有效減小器件的寄生電容,減少柵電荷量,提高開關時間,提高器件的動態(tài)性能。

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    通過對DC/DC轉換器低頻噪聲測試技術以及在y輻照前后電性能與1/f噪聲特性變化的對比分析,發(fā)現(xiàn)使用低頻噪聲表征DC/DC轉換器的可靠性是對傳統(tǒng)電參數表征方法的一種有效補充。對DC/DC轉換器輻照損傷與其內部VDMOS器件1/f噪聲相關性進行了研究,討論了引起DC/DC轉換器輻照失效的原因。

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