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低電壓PLD/FPGA的供電設(shè)計(jì)

時(shí)間：2008-04-21 13:55:00

關(guān)鍵字： FPGA 低電壓 PLD 供電設(shè)計(jì)

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[導(dǎo)讀]由于半導(dǎo)體制造工藝的原因，低電壓器件的成本比傳統(tǒng)5V器件更低，性能更優(yōu)。面對(duì)低電壓芯片的廣泛使用，我們必須重新改造我們的電源系統(tǒng)。

由于半導(dǎo)體制造工藝的原因，低電壓器件的成本比傳統(tǒng)5V器件更低，性能更優(yōu)，加上多數(shù)器件的I/O腳可以兼容5v/3.3v TTL電平，可以直接使用在原有系統(tǒng)中，所以各大半導(dǎo)體公司都將3.3v,2.5v等低電壓集成電路作為推廣重點(diǎn)，如高端的DSP,PLD/FPGA產(chǎn)品已廣泛采用3.3v,2.5v甚至1.8v,1.5v供電。面對(duì)低電壓芯片的廣泛使用，我們不得不重新改造我們的電源系統(tǒng)。

圖：AS2815 1.5A低壓差線性穩(wěn)壓器應(yīng)用電路,左邊為輸出可調(diào)型，右邊為3.3v固定輸出型

那么如何得到3.3v,2.5v等低電壓呢？通常我們可以采用三種方法：

1．采用低壓差線形穩(wěn)壓芯片（LDO）

線形穩(wěn)壓芯片是一種最簡(jiǎn)單的電源轉(zhuǎn)換芯片，基本上不要外圍元件。但是傳統(tǒng)的線形穩(wěn)壓器，如78xx系列都要求輸入電壓要比輸出電壓高2v-3v以上，否則不能正常工作，但是5v到3.3v的電壓差只有1.7v，所以78xx系列已經(jīng)不能夠滿足3.3v或2.5的電源設(shè)計(jì)要求。面對(duì)這類需求，許多電源芯片公司推出了Low Dropout Regulator,即：低壓差線形穩(wěn)壓器，簡(jiǎn)稱LDO。這種電源芯片的壓差只有1.3-0.2伏，可以實(shí)現(xiàn)5v轉(zhuǎn)3.3v/2.5v，3.3v轉(zhuǎn)2.5v/1.8v等要求。生產(chǎn)LDO的公司很多，常見(jiàn)的有：ALPHA, Linear(LT), Micrel, National semiconductor,TI等

圖 LT1530-3.3 5v轉(zhuǎn)3.3v/14A 應(yīng)用電路和效率圖

3．直接采用電源模塊

考慮到開(kāi)關(guān)電源設(shè)計(jì)的復(fù)雜性，一些公司推出了基于開(kāi)關(guān)電源技術(shù)的低電壓輸出電源模塊，可靠性和效率都很高，電磁輻射小，而且可以許多模塊可以實(shí)現(xiàn)電源隔離。用戶只需要加很少的外圍元件即可使用。電源模塊最大的缺點(diǎn)是價(jià)格昂貴。常見(jiàn)生產(chǎn)電源模塊的公司有：agere（原來(lái)朗訊的微電子部），Ericsson（愛(ài)立信），Vico（懷格）等等

三種電源方案的比較：

	低壓差線性穩(wěn)壓器	開(kāi)關(guān)電源	電源模塊
優(yōu)點(diǎn)	所需外部元件數(shù)目少，使用方便，成本低，所需電路板空間小(不加散熱片時(shí))，紋波小，無(wú)電磁干擾	效率高(一般大于80%)，輸入電壓范圍較寬，輸出功率大，價(jià)格比電源模塊便宜很多	效率高(一般大于85%)，輸入電壓范圍較寬，輸出功率大，使用方便，電磁干擾小
缺點(diǎn)	效率很低(一般低于70%)，功耗較大	設(shè)計(jì)較復(fù)雜，有電磁干擾，需要一定的設(shè)計(jì)能力	價(jià)格昂貴

最終應(yīng)該采取何種電源設(shè)計(jì)方案，取決于我們?cè)O(shè)計(jì)的具體要求。通常小功率或?qū)﹄娫葱蕸](méi)有要求的時(shí)候，可以采用LDO。如對(duì)效率有較高要求，或電源功率較大，則應(yīng)該使用電源模塊或自己設(shè)計(jì)開(kāi)關(guān)電源，最終是采用電源模塊或自己設(shè)計(jì)開(kāi)關(guān)電源，則取決于成本要求和自己的設(shè)計(jì)能力。

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