STM32F4系統(tǒng)時(shí)鐘配置及描述
這里我們寫一個(gè)RCC配置函數(shù)來(lái)說(shuō)明各函數(shù)的用途，其中HSE = 8MHz。
/**
* @說(shuō)明配置STM32F407的時(shí)鐘系統(tǒng)
* @參數(shù)無(wú)
* @返回?zé)o
* @說(shuō)明 void Clock_Config(void)按如下表格配置時(shí)鐘
*
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* Supported STM32F4xx device revision | Rev A
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* System Clock source | PLL (HSE)
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* SYSCLK(Hz) | 168000000
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* HCLK(Hz) | 168000000
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* AHB Prescaler | 1
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* APB1 Prescaler | 4
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* APB2 Prescaler | 2
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* HSE Frequency(Hz) | 8000000
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* PLL_M |8
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* PLL_N | 336
*-----------------------------------------------------------------------------
* PLL_P | 2
*-----------------------------------------------------------------------------
* PLL_Q |7
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*/
void Clock_Config(void){
ErrorStatus State;
uint32_t PLL_M;
uint32_t PLL_N;
uint32_t PLL_P;
uint32_t PLL_Q;
/*配置前將所有RCC重置為初始值*/
RCC_DeInit();
/*這里選擇 外部晶振（HSE）作為 時(shí)鐘源，因此首先打開(kāi)外部晶振*/
RCC_HSEConfig(RCC_HSE_ON);
/*等待外部晶振進(jìn)入穩(wěn)定狀態(tài)*/
while( RCC_WaitForHSEStartUp() != SUCCESS );
/*
**我們要選擇PLL時(shí)鐘作為系統(tǒng)時(shí)鐘，因此這里先要對(duì)PLL時(shí)鐘進(jìn)行配置
*/
/*選擇外部晶振作為PLL的時(shí)鐘源*/
/* 到這一步為止，已有HSE_VALUE = 8 MHz.
PLL_VCO input clock = (HSE_VALUE or HSI_VALUE / PLL_M)，
根據(jù)文檔，這個(gè)值被建議在1~2MHz，因此我們令PLL_M = 8，
即PLL_VCO input clock = 1MHz */
PLL_M = 8;
/* 到這一步為止，已有PLL_VCO input clock = 1 MHz.
PLL_VCO output clock = (PLL_VCO input clock) * PLL_N,
這個(gè)值要用來(lái)計(jì)算系統(tǒng)時(shí)鐘，我們 令PLL_N = 336,
即PLL_VCO output clock = 336 MHz.*/
PLL_N = 336;
/* 到這一步為止，已有PLL_VCO output clock = 336 MHz.
System Clock = (PLL_VCO output clock)/PLL_P ,
因?yàn)槲覀円猄ystemClock = 168 Mhz，因此令PLL_P = 2.
*/
PLL_P = 2;
/*這個(gè)系數(shù)用來(lái)配置SD卡讀寫，USB等功能，暫時(shí)不用，根據(jù)文檔，暫時(shí)先設(shè)為7*/
PLL_Q = 7;
/* 配置PLL并將其使能，獲得168Mhz的System Clock時(shí)鐘*/
RCC_PLLConfig(RCC_PLLSource_HSE, PLL_M, PLL_N, PLL_P, PLL_Q);
RCC_PLLCmd(ENABLE);
/*到了這一步，我們已經(jīng)配置好了PLL時(shí)鐘。下面我們配置Syetem Clock*/
/*選擇PLL時(shí)鐘作為系統(tǒng)時(shí)鐘源*/
RCC_SYSCLKConfig(RCC_SYSCLKSource_PLLCLK);
/*到了這一步，我們已經(jīng)配置好了系統(tǒng)時(shí)鐘，頻率為168MHz.下面我們可以對(duì)AHB，APB，外設(shè)等的時(shí)鐘進(jìn)行配置*/
/*時(shí)鐘的結(jié)構(gòu)請(qǐng)參考用戶手冊(cè)*/
/*首先配置AHB時(shí)鐘（HCLK）.為了獲得較高的頻率，我們對(duì)SYSCLK 1分頻，得到HCLK*/
RCC_HCLKConfig(RCC_HCLK_Div1);
/*APBx時(shí)鐘（PCLK）由AHB時(shí)鐘（HCLK）分頻得到，下面我們配置PCLK*/
/*APB1時(shí)鐘配置. 4分頻，即PCLK1 = 42 MHz*/
RCC_PCLK1Config(RCC_HCLK_Div4);
/*APB2時(shí)鐘配置. 2分頻，即PCLK2 = 84 MHz*/
RCC_PCLK2Config(RCC_HCLK_Div2);
/*****函數(shù)結(jié)束******/
/*以上函數(shù)可以大體上說(shuō)明這些庫(kù)函數(shù)的作用*/
}
對(duì)于 RCC_PLLConfig();函數(shù)，大家可能會(huì)迷惑。
其函數(shù)原型為：
void RCC_PLLConfig(uint32_t RCC_PLLSource,
uint32_t PLLM,
uint32_t PLLN,
uint32_t PLLP,
uint32_t PLLQ)；
迷惑的地方肯定在于后面4個(gè)參數(shù)PLLM / PLLN / PLLP / PLLQ.
在庫(kù)函數(shù)源文件 system_stm32f4xx.c中可以找到這4個(gè)參數(shù)的說(shuō)明，請(qǐng)看下圖注釋部分:
（下面的是從 庫(kù)函數(shù)源文件 stm32f4xx_rcc.c 中找到的。其他函數(shù)可以直接去看庫(kù)函數(shù)，注釋非常詳細(xì)）
/**
* @brief Configures the main PLL clock source, multiplication and division factors.
@簡(jiǎn)介 配置主PLL時(shí)鐘源，以及分頻因子
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