PCI Express（ PCIe） 標(biāo)準(zhǔn)是一種串行總線技術(shù)，可解決傳統(tǒng)并行 PCI 和 PCI-X 總線的缺陷并取而代之。日前，PCIe 2.0 標(biāo)準(zhǔn)已將該性能提高了一倍，達(dá)到了 5.0GT/s（千兆傳輸/秒）。PCIe是所有高性能應(yīng)用（包括服務(wù)器、存儲設(shè)備、外設(shè)、圖形設(shè)備和成像設(shè)備等等）進(jìn)行互連的最佳選擇。為確保系統(tǒng)能夠與飛速增加的PCIe設(shè)備實現(xiàn)互通并且穩(wěn)定工作，可靠性測試是非常重要的一個環(huán)節(jié)。

安捷倫科技公司日前推出在實際系統(tǒng)中能對PCIe設(shè)備進(jìn)行破壞性測試的具有在線誤碼注入功能的 PCIe干擾發(fā)射機（Jammer）N5323A，用于進(jìn)行 PCIe協(xié)議測試。

安捷倫電子測量事業(yè)部數(shù)字測試高級市場工程師冀衛(wèi)東介紹說，Jammer 采用了突破性的 PCIe 測試?yán)砟?，是一種創(chuàng)新的測試工具，幾乎可創(chuàng)建任何一種可能想像到的錯誤測試情況。它可以部署在兩個設(shè)備之間，而不會對系統(tǒng)產(chǎn)生任何影響；并能實時修改實際的PCIe數(shù)據(jù)傳輸，它是通過圖形序列器來驅(qū)動誤碼注入，不需要編寫代碼，以創(chuàng)建破壞性測試環(huán)境，擴大測試范圍。

冀衛(wèi)東說，這種干擾行為可發(fā)生在物理層、數(shù)據(jù)鏈路和傳輸層。例如，在物理層，Jammer可以執(zhí)行和干擾行為是提供符號、通道和數(shù)據(jù)包上的不一致錯誤、丟失STP/END字符等。在數(shù)據(jù)鏈路層上能提供丟失指定的DLLP和插入任意DLLP、以及錯誤的CRC值等。在傳輸層上Jammer可提供延遲TLP、丟失/插入TLP和替換TLP凈荷等。這使開發(fā)人員和測試工程師能夠更好地改正設(shè)計錯誤，避免為后期的產(chǎn)品更改或產(chǎn)品召回付出高昂代價，幫助開發(fā)人員縮短測試周期和加快器件的上市速度。

據(jù)了解，為了實現(xiàn)從測試到調(diào)試的無縫過渡，Agilent N5323A PCIe Jammer還可與Agilent PCIe E2960B系列協(xié)議分析儀配合使用。Jammer能夠生成誤碼并觸發(fā)分析儀，進(jìn)而對分析儀的響應(yīng)進(jìn)行捕獲和顯示。這一設(shè)置使測試工程師能夠查看注入誤碼前后的流量，以確保采取了適當(dāng)?shù)幕謴?fù)機制。

冀衛(wèi)東表示，安捷倫針對PCIe測試能提供能夠一套完整的解決方案，例如，實時和采樣示波器用來驗證信號完整性；誤碼分析儀用來測試抖動容限；協(xié)議分析儀用來對數(shù)據(jù)鏈路層和傳輸層進(jìn)行深入分析；Jammer(干擾機) 用來進(jìn)行在線錯誤注入；還提供了全功能的訓(xùn)練器和協(xié)議測試卡，包括鏈路訓(xùn)練與狀態(tài)機(裝置)（LTSSM），支持流量生成、協(xié)議層驗證，以及性能測試等。

與此同時，安捷倫還推出了可對下一代傳遞時鐘設(shè)計和嵌入式時鐘進(jìn)行全面抖動容限測試的測試儀J-BERT N4903B，該測試儀可以表征設(shè)備輸入的抖動容限，通過仿真抖動情況（例如 PCIe 2.0 一致性規(guī)范所要求的隨機抖動、雙音周期抖動、ISI、正弦干擾、SSC 和殘余 SSC）來檢查是否符合一致性要求。在信號分析方面，N4903B 內(nèi)置了快速的總抖動測試量功能、誤碼掃描功能、眼圖模板測試和眼圖分析工具以便對 PCIe 2.0 設(shè)計進(jìn)行測量。

據(jù)了解，針對DisplayPort （連接下一代視頻驅(qū)動器與數(shù)字顯示器的高速串行接口）安捷倫也有一套完整的解決方案。

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