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ADI發(fā)表18款全新低功率ADC

時(shí)間：2009-06-20 18:48:00

關(guān)鍵字： ADC ADI 低功率 CMOS

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[導(dǎo)讀]美商亞德諾公司（Analog Devices）14日正式發(fā)表18款極具電源效率，解析度範(fàn)圍從10到16位元的類比數(shù)位轉(zhuǎn)換器（ADC）。ADI的全新ADC乃是以對(duì)於電力需求極為敏感的通訊、工業(yè)、可攜式電子裝置、以及儀器設(shè)備等為對(duì)象所設(shè)

美商亞德諾公司（Analog Devices）14日正式發(fā)表18款極具電源效率，解析度範(fàn)圍從10到16位元的類比數(shù)位轉(zhuǎn)換器（ADC）。ADI的全新ADC乃是以對(duì)於電力需求極為敏感的通訊、工業(yè)、可攜式電子裝置、以及儀器設(shè)備等為對(duì)象所設(shè)計(jì)，相較於許多同質(zhì)性ADC，可以降低功率耗損達(dá)到60%之多，並且擁有同級(jí)產(chǎn)品中最佳的雜訊性能與動(dòng)態(tài)範(fàn)圍。

附圖 : 全新低功率ADC

所有ADI的新款低功率雙工ADC都能夠以單工1.8 V類比式電源供應(yīng)運(yùn)作，而且都具有高性能的取樣與保存（sample -and -hold）電路以及晶片內(nèi)建的電壓參考器。AD 9251家族擁有獨(dú)立的驅(qū)動(dòng)器電源供應(yīng)，藉以提供1.8 V或是3.3 V的CMOS邏輯輸出，而AD 9268家族則提供了1.8 V的LVDS或是CMOS輸出。

ADC的核心採(cǎi)用了具有整合式輸出誤差校正邏輯電路的多級(jí)差動(dòng)管線架構(gòu)。這些ADC在設(shè)計(jì)上還具有彈性最大化與系統(tǒng)成本最小化的特點(diǎn)，其中包括有可編程時(shí)脈、資料校準(zhǔn)、以及可編程數(shù)位化測(cè)試樣本（test-pattern）產(chǎn)生功能等?？晒┦褂玫臄?shù)位化測(cè)試樣本包括有內(nèi)建、定型（deterministic）以及虛擬隨機(jī)（pseudo-random）樣本，還有使用者可以透過(guò)串列週邊介面（SPI）輸入的可自行定義測(cè)試樣本。

ADI的全新低功率雙工ADC目前已經(jīng)開(kāi)始提供樣品，採(cǎi)用無(wú)鉛9 mm x 9 mm晶片大小的封裝方式。預(yù)計(jì)將於2009年6月正式量產(chǎn)。

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