2002年11月26日，北京-安捷倫科技（Agilent Technologies, 紐約證券交易所上市代號(hào)：A）日前宣布，其最新的0.13微米嵌入式串行/解串行 (SerDes) 半導(dǎo)體IP (專利) Core 實(shí)現(xiàn)了重大突破。新的IP Core功耗低，實(shí)現(xiàn)了最低的抖動(dòng)，使安捷倫能夠把多達(dá)150條SerDes信道集成到一個(gè)專用集成電路(ASIC)上，每條信道的工作速率可以高達(dá)3.125 Gb/s。

與以往相比，突破性的IP Core可以在一個(gè)芯片上集成更多的SerDes信道。通過集成多條信道，網(wǎng)絡(luò)設(shè)備制造商(NEMs)可以提高SerDes系統(tǒng)設(shè)計(jì)的可靠度，縮小其尺寸、并降低其復(fù)雜程度及成本，實(shí)現(xiàn)下一代高帶寬網(wǎng)絡(luò)和存儲(chǔ)系統(tǒng)。

安捷倫科技公司半導(dǎo)體產(chǎn)品事業(yè)部大中國區(qū)總經(jīng)理趙子澤先生表示：“安捷倫已經(jīng)成為嵌入式SerDes技術(shù)的領(lǐng)導(dǎo)者。本次推出的新產(chǎn)品進(jìn)一步強(qiáng)化了我們?cè)谠擃I(lǐng)域的領(lǐng)導(dǎo)地位。我們希望為廣大客戶及時(shí)、大批量地提供這些復(fù)雜的高性能芯片，使他們能從這種突破性的技術(shù)中受益?！?/P>

安捷倫在ASIC領(lǐng)域的能力基于該公司設(shè)計(jì)支持超高SerDes信道數(shù)的高晶體管ASIC的經(jīng)驗(yàn)。安捷倫曾經(jīng)在一個(gè)CMOS(互補(bǔ)金屬氧化物半導(dǎo)體)芯片上集成了50多條2.5 Gb/s的發(fā)射和接收信道；而后，又生產(chǎn)了一種集成了36條多速率SerDes信道的ASIC，每條信道的工作速率高達(dá)3.125 GB/s。

安捷倫新推出的嵌入式SerDes Core展示了業(yè)內(nèi)最低的抖動(dòng)性能。抖動(dòng)性能是用來衡量網(wǎng)元的工作性能的一個(gè)關(guān)鍵指標(biāo)，抖動(dòng)越低，性能越好。網(wǎng)絡(luò)中感應(yīng)到的任何相位偏差或抖動(dòng)都可能會(huì)導(dǎo)致傳輸質(zhì)量下降、誤碼和數(shù)據(jù)丟失。安捷倫新推出的SerDes Core的均方根(RMS)低于2皮秒，實(shí)現(xiàn)了優(yōu)秀的隨機(jī)抖動(dòng)性能，可以在網(wǎng)絡(luò)設(shè)備背板應(yīng)用中支持優(yōu)于10-17的誤碼率(BER)。BER表明了一個(gè)比特被誤釋的概率，BER越低，數(shù)據(jù)傳輸越可靠、一致性越高。

安捷倫提供的新型0.13微米SerDes Core，可以組合在超高信道數(shù)的芯片中。低功率 Core的典型工作功率為75mW，符合XAUI、光纖通道和InfiniBand標(biāo)準(zhǔn)。它還帶有可以選擇的參考時(shí)鐘，并支持背板應(yīng)用和芯片到芯片應(yīng)用。其最大可用行程 (定義為一串連續(xù)的1或0) 超過100位，高于SONET/SDH要求。

安捷倫擁有二十多年的ASIC設(shè)計(jì)和制造經(jīng)驗(yàn)，開發(fā)出了一流的分層設(shè)計(jì)方法和試驗(yàn)設(shè)計(jì)功能。安捷倫在設(shè)計(jì)和制造這些芯片時(shí)，保持著很高的一次合格率。這些優(yōu)勢與完整的專利產(chǎn)品系列相結(jié)合，便于為通信、影像和計(jì)算等多種應(yīng)用領(lǐng)域迅速提供優(yōu)質(zhì)、高性能的ASIC。如需更多信息，請(qǐng)?jiān)L問網(wǎng)址：www.agilent.com/semiconductors。