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ASIC設(shè)計(jì)中驗(yàn)證工具選擇實(shí)例
前言 伴隨著工藝技術(shù)水平的提高，當(dāng)前ASIC設(shè)計(jì)規(guī)模和設(shè)計(jì)復(fù)雜度也不斷的提高。合理的選擇驗(yàn)證工具在ASIC設(shè)計(jì)過(guò)程中起了關(guān)鍵作用。下面就結(jié)合實(shí)際的項(xiàng)目開(kāi)發(fā)，對(duì)比驗(yàn)證工具的特點(diǎn)，幫助大家更好的認(rèn)識(shí)驗(yàn)證工具?！
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Actel發(fā)布具有并行編程能力的FPGA工具
Actel公司新近推出其第三代FPGA編程工具--Silicon Sculptor 3。據(jù)Actel稱(chēng)，Silicon Sculptor 3配置有一個(gè)高速USB2.0接口，用戶(hù)可通過(guò)該USB接口將12個(gè)編程器連接至單臺(tái)PC機(jī)。該Silicon Sculptor 3與Silicon Sculptor
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在ISE工具中使用Xplorer
如下圖所示，創(chuàng)建一個(gè)ISE工程。右擊(Process)窗口中的(Implement Design)選項(xiàng)，然后選擇(Category)—(Xplorer Properties)命令，在彈出的對(duì)話框中把(Xplorer Mode)的值改為(Timing Cloure)，并根據(jù)自己的情況設(shè)置其他
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EDK工具中硬件平臺(tái)
EDK工具中硬件平臺(tái)部分的描述包含在MHS(Microprocessor Hardware Specification)文件中，這個(gè)文件是用高級(jí)語(yǔ)言格式描述處器器系統(tǒng)的硬件平臺(tái)。它是可編輯的文本文件，是用于綜合生成HDL網(wǎng)表的輸入文件，為后續(xù)的布局
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EDK工具自定義IP核
EDK工具自帶了豐富的IP核，方便用戶(hù)構(gòu)建復(fù)雜的嵌入式系統(tǒng)。用戶(hù)也可以通過(guò)EDK提供的CIP(Create or Import Penpheral)向?qū)?lái)構(gòu)建自己的IP核實(shí)現(xiàn)特定的一些功能來(lái)擴(kuò)充自己的IP庫(kù)，并達(dá)到IP核復(fù)用的目的。 CIP在建立用戶(hù)
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文本化數(shù)學(xué)工具M(jìn)athScript
MathScript通過(guò)一種面向數(shù)學(xué)的文本編程語(yǔ)言對(duì)LabVIEW進(jìn)行擴(kuò)展，用來(lái)進(jìn)行數(shù)學(xué)運(yùn)算與信號(hào)分析處理，擴(kuò)展功能如下。 1．文本數(shù)學(xué)功能 MathScript內(nèi)置超過(guò)600種函數(shù)，用于數(shù)學(xué)運(yùn)算、信號(hào)分析處理，包括線性代數(shù)、曲線擬合
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LabVIEW的工具選板
工具選板提供了VI程序設(shè)計(jì)時(shí)可以選用的基本工具，如圖2所示，在前面板和程序框圖窗口均可打開(kāi)使用。單擊選板右上角“×”可關(guān)閉工具選板。在前面板或程序框圖窗口的空白區(qū)域按下<Shift+鼠標(biāo)右鍵>，也可彈出臨時(shí)工具
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HyperLynx工具設(shè)計(jì)簡(jiǎn)介
HyperLynx設(shè)計(jì)工具包括兩個(gè)部分，即LineSim(實(shí)現(xiàn)布局布線前的分析)和BoardSim(實(shí)現(xiàn)布局布線后的分析)，以下簡(jiǎn)單地介紹使用LineSim工具來(lái)實(shí)現(xiàn)布局布線前的信號(hào)完整性分析和設(shè)計(jì)。 (1)LineSim工具 HyperLynx的LineSim工
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LabVIEW的圖形工具選板
圖形工具選板，如圖1所示。通過(guò)圖形工具選板可進(jìn)行游標(biāo)移動(dòng)、縮放、平移顯示圖像等操作。圖形工具選板還包括包含信號(hào)信息的各種屬性，下列按鈕從左到右依次為游標(biāo)移動(dòng)工具、縮放工具、平移工具 。 圖1 坐標(biāo)圖例 游標(biāo)
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Actel LIBERO IDE 8.5軟件工具支持其N(xiāo)ANO FPGA
Actel公司宣布推出Libero集成設(shè)計(jì)環(huán)境(IDE)8.5版本，這套完整的軟件設(shè)計(jì)工具系列已進(jìn)一步擴(kuò)展，支持新近推出的nano版本IGLOO和ProASIC3現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)。Libero IDE 8.5版本還提供對(duì)嵌入式數(shù)學(xué)構(gòu)件(mathblock
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C/C++編譯器工具的主要特點(diǎn)
下面說(shuō)明源代碼編譯器工具的主要特點(diǎn)。 ●源代碼交疊工具（Source Interlist Feature）。編譯器工具中包含一個(gè)源代碼交疊工具，它把C/C++語(yǔ)句和編譯后的匯編語(yǔ)句對(duì)應(yīng)交疊在一起。用戶(hù)可以使用這個(gè)工具觀察與C/C++語(yǔ)句
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奧地利微發(fā)布設(shè)計(jì)/仿真/分析工具analogbench
奧地利微電子公司(AMS)近日發(fā)布一款設(shè)計(jì)、仿真和分析工具analogbench，可*估奧地利微電子創(chuàng)新的DC-DC轉(zhuǎn)換器的性能。 analogbench可仿真用戶(hù)獨(dú)特的設(shè)計(jì)，分析整個(gè)設(shè)計(jì)的性能、優(yōu)化DC-DC的效率。用戶(hù)輸入有關(guān)的電壓和電
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EDA工具介紹之Magma工具簡(jiǎn)介
〓 Blast Create 設(shè)計(jì)師可以通過(guò)Blast Create對(duì)RTL級(jí)代碼進(jìn)行綜合、觀察、*估，改善其代碼質(zhì)量、設(shè)計(jì)約束和設(shè)計(jì)可測(cè)性；并且通過(guò)SVP技術(shù)建立精確地設(shè)計(jì)原型進(jìn)行布局規(guī)劃。 Blast Create 包括邏輯綜合、物理綜合、DFT
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Premier Farnell推出集成DesignLink接口的CAD工具EAGLE軟件第5.10.0 版本
派睿電子的母公司Premier Farnell集團(tuán)近日宣布推出集成了DesignLink(數(shù)據(jù)轉(zhuǎn)換)接口的CAD工具EAGLE軟件第5.10.0 版本。最新版CadSoft(Premier Farnell子公司)EAGLE軟件是同類(lèi)產(chǎn)品中最為暢銷(xiāo)的CAD工具，集成了“Design
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全新Icicle 工具套件上市
Actel公司推出全新Icicle? 工具套件，進(jìn)一步彰顯業(yè)界最低功耗現(xiàn)場(chǎng)可編程門(mén)陣列 （FPGA） 在便攜式解決方案中的優(yōu)勢(shì)。新工具套件充分利用Actel的5微瓦 （μW） IGLOO? FPGA，展現(xiàn)了IGLOO在便攜式應(yīng)用中的超低功耗特性
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3D IC的EDA工具之路
最近提出了有關(guān)3D IC的三個(gè)問(wèn)題：什么是3D IC，它們是否實(shí)際可行，以及它們有什么不同？這些問(wèn)題的答案可能多種多樣，但半導(dǎo)體業(yè)確實(shí)正在逐漸地為傳統(tǒng)二維摩爾定律標(biāo)尺增加一個(gè)垂直維度（即堆疊）。 減少I(mǎi)C之間互連
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微芯全新增強(qiáng)型可視化設(shè)計(jì)工具GDD X
Microchip GDD X支持在Windows、Linux或Mac電腦上創(chuàng)建基于PIC MCU的GUI.易于使用的工具有助于開(kāi)發(fā)圖形用戶(hù)界面，并節(jié)省寶貴的設(shè)計(jì)時(shí)間。 整合單片機(jī)、混合信號(hào)、模擬器件和閃存專(zhuān)利解決方案的供應(yīng)商--Microchip Tech
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Mentor Volcano和Capital工具在JAC車(chē)載通信成功部署
導(dǎo)讀：日前，Mentor Graphics Corporation和中國(guó)汽車(chē)制造商江淮汽車(chē)（JAC）共同宣布成功部署Mentor Volcano和Capital工具。由Mentor提供的新軟件設(shè)計(jì)技術(shù)在JAC乘用車(chē)和商用車(chē)的多個(gè)項(xiàng)目上均已得到部署，為JAC帶來(lái)了車(chē)
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工程師必備：15款精選免費(fèi)的設(shè)計(jì)模擬工具
如今，越來(lái)越多的免費(fèi)電子工程工具出現(xiàn)在我們眼前。這些免費(fèi)工具可以很容易的在網(wǎng)絡(luò)上搜尋，并且資源量上不計(jì)其數(shù)。但其中也不乏一些沒(méi)有太大價(jià)值的。本文為電子工程師們整理出了一些實(shí)用的在線工具，以供參考（排序
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常見(jiàn)硬件設(shè)計(jì)5種EDA工具分享
EDA簡(jiǎn)介EDA是電子設(shè)計(jì)自動(dòng)化（Electronics Design AutomaTIon）的縮寫(xiě)，在20世紀(jì)60年代中期從計(jì)算機(jī)輔助設(shè)計(jì)（CAD）、計(jì)算機(jī)輔助制造（CAM）、計(jì)算機(jī)輔助測(cè)試（CAT）和計(jì)算機(jī)輔助工程（CAE）的概念發(fā)展而來(lái)的。20世紀(jì)
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