DSP
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最新C6A816x Integra DSP + ARM處理器（TI）
日前，德州儀器 (TI) 宣布在現(xiàn)有數(shù)字信號(hào)處理器 (DSP) + ARM® 產(chǎn)品的成功基礎(chǔ)上推出 C6A816x Integra™ DSP + ARM 系列處理器。C6A816x Integra DSP + ARM 處理器不但可提供高達(dá) 1.5 GHz 的業(yè)界最快單內(nèi)核浮
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最新C6A816x Integra DSP + ARM處理器（TI）
最新C6A816x Integra DSP + ARM處理器（TI）
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大容量無線傳輸技術(shù)中DSP的啟動(dòng)
1 引言 在極低譜密度，高頻譜利用率的大容量無線傳輸技術(shù)中，高速實(shí)時(shí)信號(hào)處理成為技術(shù)的 關(guān)鍵。目前市場上，能滿足對(duì)高速實(shí)時(shí)信號(hào)處理的需要有具有良好的可編程性的器件主要有 DSP 和FPGA。 TMS320C6000 系
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大容量無線傳輸技術(shù)中DSP的啟動(dòng)
大容量無線傳輸技術(shù)中DSP的啟動(dòng)
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大容量無線傳輸技術(shù)中DSP的啟動(dòng)
大容量無線傳輸技術(shù)中DSP的啟動(dòng)
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基于DSP與FPGA的藍(lán)牙數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
介紹了采用TMS320F1218(DSP)與EP2C5(FPGA)作為協(xié)同處理模塊完成系統(tǒng)的控制與處理以及采用BlueCore2-External藍(lán)牙模塊實(shí)現(xiàn)數(shù)據(jù)無線傳輸、藍(lán)牙數(shù)據(jù)采集系統(tǒng)實(shí)現(xiàn)的硬件和軟件設(shè)計(jì)原理。測試表明，該系統(tǒng)能夠?qū)崿F(xiàn)數(shù)據(jù)實(shí)時(shí)、精確、高速采集。
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基于DSP與FPGA的藍(lán)牙數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
基于DSP與FPGA的藍(lán)牙數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
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基于DSP Builder的帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)
提出一種設(shè)計(jì)全數(shù)字鎖相環(huán)的新方法，采用基于PI控制算法的環(huán)路濾波器，在分析模擬鎖相環(huán)系統(tǒng)的數(shù)學(xué)模型的基礎(chǔ)上，建立了帶寬自適應(yīng)全數(shù)字鎖相環(huán)的數(shù)學(xué)模型。使用DSP Builder在Matlab／Simulink環(huán)境下搭建系統(tǒng)模型，并采用FPGA實(shí)現(xiàn)了硬件電路。軟件仿真和硬件測試的結(jié)果證明了該設(shè)計(jì)的正確性和易實(shí)現(xiàn)性。該鎖相環(huán)具有鎖頻速度快、頻率跟蹤范圍寬的特點(diǎn)。同時(shí)，系統(tǒng)設(shè)計(jì)表明基于DSP Builder的設(shè)計(jì)方法可縮短設(shè)計(jì)周期，提高設(shè)計(jì)的靈活性。
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基于DSP Builder的帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)
提出一種設(shè)計(jì)全數(shù)字鎖相環(huán)的新方法，采用基于PI控制算法的環(huán)路濾波器，在分析模擬鎖相環(huán)系統(tǒng)的數(shù)學(xué)模型的基礎(chǔ)上，建立了帶寬自適應(yīng)全數(shù)字鎖相環(huán)的數(shù)學(xué)模型。使用DSP Builder在Matlab／Simulink環(huán)境下搭建系統(tǒng)模型，并采用FPGA實(shí)現(xiàn)了硬件電路。軟件仿真和硬件測試的結(jié)果證明了該設(shè)計(jì)的正確性和易實(shí)現(xiàn)性。該鎖相環(huán)具有鎖頻速度快、頻率跟蹤范圍寬的特點(diǎn)。同時(shí)，系統(tǒng)設(shè)計(jì)表明基于DSP Builder的設(shè)計(jì)方法可縮短設(shè)計(jì)周期，提高設(shè)計(jì)的靈活性。
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FPGAs的DSP性能分析
FPGA在高性能數(shù)字信號(hào)處理領(lǐng)域越來越受關(guān)注，如無線基站。在這些應(yīng)用中， FPGAs通常被用來和DSP處理器并行工作。有更多的選擇當(dāng)然是好的，但這也意味著系統(tǒng)設(shè)計(jì)師需要一個(gè)確切的FPGAs及高端DSP信號(hào)處理器性能參數(shù)圖
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FPGAs的DSP性能分析
FPGAs的DSP性能分析
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最新 DSP + ARM軟件工具（TI）
日前，德州儀器 (TI) 宣布推出兩款免費(fèi)軟件開發(fā)工具，幫助 ARM®、Linux™ 以及系統(tǒng)開發(fā)人員便捷地利用 TI 集成型浮點(diǎn)與定點(diǎn) DSP + ARM 處理器旗下 TMS320C6000™ 數(shù)字信號(hào)處理器 (DSP) 的實(shí)時(shí)高密度信
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最新 DSP + ARM軟件工具（TI）
最新 DSP + ARM軟件工具（TI）
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最新 DSP + ARM軟件工具（TI）
最新 DSP + ARM軟件工具（TI）
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RF、SSP及DSP處理電路
RF、SSP及DSP處理電路伺服電路的組成：由RF放大、伺服處理KB9223(SU3)，DSP處理KS9284(SU2)，聚焦、循跡、主軸、進(jìn)給、進(jìn)出倉電機(jī)驅(qū)動(dòng)KA9259(SU4)等組成。 整機(jī)原理框圖見85頁附圖。1、RF數(shù)字信號(hào)處理 從光盤反射回
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基于System ACE的DSP文件系統(tǒng)設(shè)計(jì)
引 言 目前，對(duì)圖像處理系統(tǒng)的速度和精度要求越來越高，采樣的數(shù)據(jù)量也越來越大。而嵌入式系統(tǒng)中的硬件資源環(huán)境一般比較苛刻，嵌入式微處理器和微控制器的內(nèi)存一般都不大。為了能夠?qū)崿F(xiàn)DSP(Digital Signal Proce
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基于System ACE的DSP文件系統(tǒng)設(shè)計(jì)
基于System ACE的DSP文件系統(tǒng)設(shè)計(jì)
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基于System ACE的DSP文件系統(tǒng)設(shè)計(jì)
基于System ACE的DSP文件系統(tǒng)設(shè)計(jì)
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基于DSP的雙光柵匹配解調(diào)系統(tǒng)
0 引言 光纖布拉格光柵傳感器(FBGS)是用光纖布拉格光柵(FBG)作敏感元件的功能型光纖傳感器，可用于直接檢測溫度和應(yīng)變，以及與溫度和應(yīng)變有關(guān)的其他許多物理量和化學(xué)量的間接測量。在光纖布拉格光柵傳感器的應(yīng)用
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基于DSP的雙光柵匹配解調(diào)系統(tǒng)
基于DSP的雙光柵匹配解調(diào)系統(tǒng)
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