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  • 拉普拉斯算子的FPGA實(shí)現(xiàn)方法

    為了能快速實(shí)現(xiàn)Laplacian算子高頻增強(qiáng)功能，通過理論研究設(shè)計(jì)出該算子實(shí)現(xiàn)的硬件結(jié)構(gòu)。提出一種調(diào)用仿真軟件中宏功能塊快速實(shí)現(xiàn)算法的硬件實(shí)現(xiàn)模式。詳細(xì)介紹使用QuattusⅡ中Megafunctions宏功能模塊庫實(shí)現(xiàn)3×3模板Laplacian算子的過程。通過實(shí)驗(yàn)結(jié)果表明，用該方法實(shí)現(xiàn)的算子能夠取得良好的濾波效果，且設(shè)計(jì)方便、有效，為相似功能模塊的設(shè)計(jì)提供了新思路。

  • 基于DSP Builder的Chirp信號源設(shè)計(jì)

    設(shè)計(jì)分析了Chirp函數(shù)在時(shí)域和頻域內(nèi)的一般特點(diǎn)和解析公式。提出首先在Altera DSP開發(fā)工具DSP Builder中實(shí)現(xiàn)直接數(shù)字合成器(DDS)模塊，根據(jù)Chirp函數(shù)特定的輸入／輸出(線性和非線性)關(guān)系，計(jì)算出當(dāng)前輸入字與輸出頻率的對應(yīng)關(guān)系；然后設(shè)計(jì)控制字子模塊產(chǎn)生DDS模塊的頻率控制字，驅(qū)動DDS產(chǎn)生不同的輸出頻率，通過在Matlab的Simu-link環(huán)境下的仿真驗(yàn)證，得出不同時(shí)刻輸出的頻譜圖，驗(yàn)證了該設(shè)計(jì)能很好地實(shí)現(xiàn)Chirp信號源。

  • 基于DDS技術(shù)的雜散分析及抑制方法

    頻率合成技術(shù)起源于二十世紀(jì)30年代，當(dāng)時(shí)所采用的頻率合成方法是直接頻率合成。它是利用混頻、倍頻、分頻的方法由參考源頻率經(jīng)過加、減、乘、除運(yùn)算，直接組合出所需要的的頻率。它的優(yōu)點(diǎn)是捷變速度快，相位噪

  • RTEMS管理機(jī)制與USB驅(qū)動程序設(shè)計(jì)

    介紹RTEMS實(shí)時(shí)操作系統(tǒng)和USB協(xié)議，分析RTEMS系統(tǒng)的設(shè)備管理機(jī)制，詳細(xì)描述RTEMS操作系統(tǒng)下的USB設(shè)備驅(qū)動程序的設(shè)計(jì)與實(shí)現(xiàn)。該設(shè)計(jì)根據(jù)USB的特點(diǎn)，通過合理的層次劃分，將驅(qū)動程序分為硬件抽象層和設(shè)備類驅(qū)動層，在硬件抽象層完成對USB設(shè)備控制器的操作，在設(shè)備類驅(qū)動層實(shí)現(xiàn)對各類USB設(shè)備命令的處理，保證了驅(qū)動程序易于移植和擴(kuò)展。按照RTEMS的設(shè)備管理機(jī)制，為在RTEMS上運(yùn)行的任務(wù)提供了標(biāo)準(zhǔn)I／0系統(tǒng)調(diào)用。

  • Cache結(jié)構(gòu)的低功耗可重構(gòu)技術(shù)研究

    在分析Cache性能的基礎(chǔ)上介紹了當(dāng)前低功耗Cache的設(shè)計(jì)方法，提出了一種可重構(gòu)Cache模型和動態(tài)可重構(gòu)算法。Cache模型能夠在程序運(yùn)行過程中改變相聯(lián)度和大小，動態(tài)可重構(gòu)算法能夠在運(yùn)行時(shí)針對不同的應(yīng)用程序?qū)芍貥?gòu)Cache進(jìn)行配置。通過對Cache的動態(tài)配置，不僅可以提高Cache命中率，還能夠有效降低處理器的功耗。

  • 基于SOA的網(wǎng)卡銀行客戶評估系統(tǒng)研究與實(shí)現(xiàn)

    針對當(dāng)前網(wǎng)上銀行個(gè)人客戶分布中存在著明顯的“二八”效應(yīng)，提出基于Ajax的網(wǎng)上銀行客戶評估系統(tǒng)，從交互性、性能等角度探討SOA和Ajax技術(shù)，并結(jié)合SOA和Ajax實(shí)現(xiàn)集數(shù)據(jù)采集、模型建立、模型評估與高端客戶預(yù)測的網(wǎng)上銀行客戶評估系統(tǒng)。該系統(tǒng)基于B／S結(jié)構(gòu)，解決了網(wǎng)上銀行個(gè)人客戶分布存在的“二八”效應(yīng)，提高了Web系統(tǒng)數(shù)據(jù)響應(yīng)時(shí)間和數(shù)據(jù)傳輸效率，實(shí)現(xiàn)了跨平臺操作，并減輕了服務(wù)器端的負(fù)擔(dān)，且通過實(shí)踐驗(yàn)證了系統(tǒng)的有效性。

  • 基于數(shù)據(jù)挖掘的入侵檢測系統(tǒng)的改進(jìn)與實(shí)現(xiàn)

    針對已有Apriori算法存在的問題，設(shè)計(jì)新的基于引用作用度的Apriori_lift算法，從而提高關(guān)聯(lián)規(guī)則的挖掘性能。通過實(shí)驗(yàn)仿真，結(jié)果表明Apriori_lift算法在挖掘結(jié)果方面明顯優(yōu)于Aprio ri算法。應(yīng)用Apriori_lift算法對現(xiàn)有的基于數(shù)據(jù)挖掘的入侵檢測系統(tǒng)進(jìn)行改進(jìn)。改進(jìn)后的系統(tǒng)在挖掘網(wǎng)絡(luò)數(shù)據(jù)包方面可以有效地發(fā)現(xiàn)數(shù)據(jù)包中各屬性之間的相關(guān)性，利用這一特點(diǎn)并結(jié)合協(xié)議分析、入侵分析等技術(shù)，可以通過挖掘結(jié)果中的規(guī)則去準(zhǔn)確而高效地鎖定攻擊者，從提高了系統(tǒng)檢測性能。

  • 基于DSP無線抄表系統(tǒng)設(shè)計(jì)

    為實(shí)現(xiàn)短距離無線抄表，以DSP2812為控制核心，采用先進(jìn)的電能采集芯片CS5460A，對電壓、電流、功率等進(jìn)行測量和計(jì)算。同時(shí)采用無線收發(fā)模塊nRF2401A對數(shù)據(jù)進(jìn)行無線收發(fā)，在微處理器的控制下對數(shù)據(jù)進(jìn)行處理后向上級系統(tǒng)發(fā)送，實(shí)現(xiàn)了采集終端和控制終端之間的短距離無線通信。采用DS1302作為系統(tǒng)時(shí)鐘芯片，為系統(tǒng)采集電能提供了準(zhǔn)確的時(shí)間信息。

  • Sobel邊緣檢測的FPGA實(shí)現(xiàn)

    為了采用FPGA來實(shí)時(shí)實(shí)現(xiàn)Sobel邊緣檢測，設(shè)計(jì)者往往自己編寫代碼。在此介紹基于QuartusⅡ提供的參數(shù)可設(shè)置宏功能模塊，實(shí)現(xiàn)Sobel邊緣檢測的新方案。該方案獲得了比用戶編寫的代碼更優(yōu)的綜合和實(shí)現(xiàn)結(jié)果，節(jié)省了寶貴的設(shè)計(jì)時(shí)間，并且獲得了很好的邊緣檢測效果。

  • 優(yōu)化無線基站中功率放大器的性能與效率

    隨著需要在有限的無線頻譜上承載日益增加的數(shù)據(jù)流量，無論是用戶還是數(shù)字內(nèi)容的快速增長都為無線基礎(chǔ)局端承受著巨大的壓力。滿足上述需求將產(chǎn)生高能耗，進(jìn)而導(dǎo)致基站系統(tǒng)的購置成本及其運(yùn)行費(fèi)用攀升。將無線信號從

  • 時(shí)間觸發(fā)模式下的ProtothreadS設(shè)計(jì)應(yīng)用

    Protothrcads是一種無需堆棧的極輕量級線程。本文旨在討論P(yáng)rotothrcads在時(shí)間觸發(fā)模式系統(tǒng)中所能發(fā)揮的優(yōu)勢。以一個(gè)具體例子為依據(jù)，詳細(xì)介紹了如何使用經(jīng)過改進(jìn)之后的Protothrcads構(gòu)建一個(gè)多任務(wù)調(diào)度器，并使之順利應(yīng)用于時(shí)間觸發(fā)模式的系統(tǒng)中。

  • 基于FPGA的DDS信號發(fā)生器設(shè)計(jì)

    介紹基于DDS的信號發(fā)生器工作原理和設(shè)計(jì)過程，并對關(guān)鍵模塊及外圍電路進(jìn)行了仿真和誤差分析。經(jīng)功能驗(yàn)證和分析測試，達(dá)到了預(yù)定的各項(xiàng)技術(shù)指標(biāo)。旨在建立一種以FPGA為核心，功能可裁剪、波形任意調(diào)整的高性能信號發(fā)生器設(shè)計(jì)方法。采用該設(shè)計(jì)法將有效地降低開發(fā)成本，提高設(shè)計(jì)效率，并具有一定的工程指導(dǎo)意義和實(shí)用價(jià)值。

  • 基于統(tǒng)計(jì)分析的H．264快速模式選擇算法

    為了提高H．264算法的效率，在對各種模式進(jìn)行統(tǒng)計(jì)分析的基礎(chǔ)上，針對SKIP模式，提出一種將SKIP模式與inter16×16模式的率失真代價(jià)進(jìn)行比較的快速判決算法；針對inter8×8模式，提出了一種基于紋理預(yù)測的快速選擇算法；針對intra4×4模式，提出了一種簡化算法。實(shí)驗(yàn)結(jié)果顯示，相對與JM 8．6參考軟件，PSNR平均下降0．05 dB左右，而編碼時(shí)間平均下降38％，由此說明此算法能有效地提高H．264的編碼效率。

    模擬
    2009-09-18
    IP INTER INTRA BSP

  • 基于VHDL的多功能可變模計(jì)數(shù)器設(shè)計(jì)

    可變模計(jì)數(shù)器作為一種基本數(shù)字電路模塊，在各種數(shù)字系統(tǒng)中應(yīng)用廣泛。在對現(xiàn)有的可變模計(jì)數(shù)器的研究基礎(chǔ)上，在QuartusⅡ開發(fā)環(huán)境中，用VHDL語言設(shè)計(jì)一種功能更加強(qiáng)大的可變模計(jì)數(shù)器，它具有清零、置數(shù)、使能控制、可逆計(jì)數(shù)和可變模等功能，并且對傳統(tǒng)的可變模計(jì)數(shù)器的計(jì)數(shù)失控問題進(jìn)行研究，最終設(shè)計(jì)出一種沒有計(jì)數(shù)失控缺陷的可變模計(jì)數(shù)器，并以ACEX1K系列EP1K30QC208芯片為硬件環(huán)境．驗(yàn)證了其各項(xiàng)設(shè)計(jì)功能。結(jié)果表明該設(shè)計(jì)正確，功能完整，運(yùn)行穩(wěn)定。

  • 基于符號模擬的電路中錯(cuò)誤診斷方法研究

    錯(cuò)誤診斷是在邏輯芯片中預(yù)測潛在錯(cuò)誤點(diǎn)的過程。為了快速有效地診斷電路中的錯(cuò)誤，提出一種將符號模擬技術(shù)應(yīng)用到基于區(qū)域模型的錯(cuò)誤診斷法上的新思想，具體方法是通過對要診斷的電路進(jìn)行區(qū)域劃分，然后利用符號模擬方法依據(jù)兩種測量標(biāo)準(zhǔn)對各個(gè)區(qū)域候選者進(jìn)行可疑度的等級排序，從而對電路中所含錯(cuò)誤進(jìn)行判斷?？梢啥仍礁叩膮^(qū)域，其作為錯(cuò)誤候選者的可能性越大。該方法利用符號模擬技術(shù)，不需要對向量空間進(jìn)行窮盡的列舉，因而在空間和時(shí)間上是有效的。

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