stm32f407 定時(shí)器 用的APB1 APB2 及 定時(shí)器頻率
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上午想要用Timer10做相對(duì)精確的延時(shí)功能，但是用示波器發(fā)現(xiàn)實(shí)際延時(shí)數(shù)值總是只有一半，百思不得其解。
仔細(xì)查閱各處資料結(jié)合實(shí)際研究后對(duì)stm32f407的14個(gè)定時(shí)器的時(shí)鐘做一個(gè)總結(jié)：
下面來源:http://www.openedv.com/thread-68387-1-2.html
從時(shí)鐘樹中我們可以得知（時(shí)鐘樹的圖片可以直接參考6樓，感謝6樓xkwy補(bǔ)上的圖）：
（1）高級(jí)定時(shí)器timer1, timer8以及通用定時(shí)器timer9, timer10, timer11的時(shí)鐘來源是APB2總線
（2）通用定時(shí)器timer2~timer5，通用定時(shí)器timer12~timer14以及基本定時(shí)器timer6,timer7的時(shí)鐘來源是APB1總線
從STM32F4的內(nèi)部時(shí)鐘樹可知，當(dāng)APB1和APB2分頻數(shù)為1的時(shí)候，TIM1、TIM8~TIM11的時(shí)鐘為APB2的時(shí)鐘，TIM2~TIM7、TIM12~TIM14的時(shí)鐘為APB1的時(shí)鐘；而如果APB1和APB2分頻數(shù)不為1，那么TIM1、TIM8~TIM11的時(shí)鐘為APB2的時(shí)鐘的兩倍，TIM2~TIM7、TIM12~TIM14的時(shí)鐘為APB1的時(shí)鐘的兩倍。
因?yàn)橄到y(tǒng)初始化SystemInit函數(shù)里初始化APB1總線時(shí)鐘為4分頻即42M，APB2總線時(shí)鐘為2分頻即84M，所以TIM1、TIM8~TIM11的時(shí)鐘為APB2時(shí)鐘的兩倍即168M，TIM2~TIM7、TIM12~TIM14的時(shí)鐘為APB1的時(shí)鐘的兩倍即84M。
知道定時(shí)器的時(shí)鐘源頻率我們用定時(shí)器做延時(shí)就很方便了，只要設(shè)定合適的分頻系數(shù)即可，附一下用中斷實(shí)現(xiàn)延時(shí)的公式：（摘自原子的STM32F4開發(fā)指南）
Tout = ((arr+1)*(psc+1))/Tclk;
公式中psc就是分頻系數(shù)，arr就是計(jì)數(shù)值，達(dá)到這個(gè)計(jì)數(shù)就會(huì)發(fā)生溢出中斷，Tclk就是我上述分析的時(shí)鐘源頻率的倒數(shù)。
下面來源: http://blog.chinaunix.net/uid-27680183-id-3784602.html
這里我們寫一個(gè)RCC配置函數(shù)來說明各函數(shù)的用途，其中HSE = 8MHz。
/**
* @說明配置STM32F407的時(shí)鐘系統(tǒng)
* @參數(shù)無
* @返回?zé)o
* @說明 void Clock_Config(void)按如下表格配置時(shí)鐘
*
*==================================================================
* Supported STM32F4xx device revision " Rev A
*-----------------------------------------------------------------------------
* System Clock source | PLL (HSE)
*-----------------------------------------------------------------------------
* SYSCLK(Hz) | 168000000
*-----------------------------------------------------------------------------
* HCLK(Hz) | 168000000
*-----------------------------------------------------------------------------
* AHB Prescaler | 1
*-----------------------------------------------------------------------------
* APB1 Prescaler | 4
*-----------------------------------------------------------------------------
* APB2 Prescaler | 2
*-----------------------------------------------------------------------------
* HSE Frequency(Hz) | 8000000
*-----------------------------------------------------------------------------
* PLL_M |8
*-----------------------------------------------------------------------------
* PLL_N | 336
*-----------------------------------------------------------------------------
* PLL_P | 2
*-----------------------------------------------------------------------------
* PLL_Q |7
*===================================================================
*/
void Clock_Config(void){
ErrorStatus State;
uint32_t PLL_M;
uint32_t PLL_N;
uint32_t PLL_P;
uint32_t PLL_Q;
/*配置前將所有RCC重置為初始值*/
RCC_DeInit();
/*這里選擇 外部晶振（HSE）作為 時(shí)鐘源，因此首先打開外部晶振*/
RCC_HSEConfig(RCC_HSE_ON);
/*等待外部晶振進(jìn)入穩(wěn)定狀態(tài)*/
while( RCC_WaitForHSEStartUp() != SUCCESS );
/*
**我們要選擇PLL時(shí)鐘作為系統(tǒng)時(shí)鐘，因此這里先要對(duì)PLL時(shí)鐘進(jìn)行配置
*/
/*選擇外部晶振作為PLL的時(shí)鐘源*/
/* 到這一步為止，已有HSE_VALUE = 8 MHz.
PLL_VCO input clock = (HSE_VALUE or HSI_VALUE / PLL_M)，
根據(jù)文檔，這個(gè)值被建議在1~2MHz，因此我們令PLL_M = 8，
即PLL_VCO input clock = 1MHz */
PLL_M = 8;
/* 到這一步為止，已有PLL_VCO input clock = 1 MHz.
PLL_VCO output clock = (PLL_VCO input clock) * PLL_N,
這個(gè)值要用來計(jì)算系統(tǒng)時(shí)鐘，我們 令PLL_N = 336,
即PLL_VCO output clock = 336 MHz.*/
PLL_N = 336;
/* 到這一步為止，已有PLL_VCO output clock = 336 MHz.
System Clock = (PLL_VCO output clock)/PLL_P ,
因?yàn)槲覀円猄ystemClock = 168 Mhz，因此令PLL_P = 2.
*/
PLL_P = 2;
/*這個(gè)系數(shù)用來配置SD卡讀寫，USB等功能，暫時(shí)不用，根據(jù)文檔，暫時(shí)先設(shè)為7*/
PLL_Q = 7;
/* 配置PLL并將其使能，獲得168Mhz的System Clock時(shí)鐘*/
RCC_PLLConfig(RCC_PLLSource_HSE, PLL_M, PLL_N, PLL_P, PLL_Q);
RCC_PLLCmd(ENABLE);
/*到了這一步，我們已經(jīng)配置好了PLL時(shí)鐘。下面我們配置Syetem Clock*/
/*選擇PLL時(shí)鐘作為系統(tǒng)時(shí)鐘源*/
RCC_SYSCLKConfig(RCC_SYSCLKSource_PLLCLK);
/*到了這一步，我們已經(jīng)配置好了系統(tǒng)時(shí)鐘，頻率為168MHz.下面我們可以對(duì)AHB，APB，外設(shè)等的時(shí)鐘進(jìn)行配置*/
/*時(shí)鐘的結(jié)構(gòu)請(qǐng)參考用戶手冊(cè)*/
/*首先配置AHB時(shí)鐘（HCLK）.為了獲得較高的頻率，我們對(duì)SYSCLK 1分頻，得到HCLK*/
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