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基于FPGA的提取位同步時鐘DPLL設計

在數(shù)字通信系統(tǒng)中，同步技術(shù)是非常重要的，而位同步是最基本的同步。位同步時鐘信號不僅用于監(jiān)測輸入碼元信號，確保收發(fā)同步，而且在獲取幀同步及對接收的數(shù)字碼元進行各種處理的過程中也為系統(tǒng)提供了一個基準

工業(yè)控制
2009-12-28

FPGA 位同步時鐘 PLL BSP
Altium牽手工信部辦"全國電子專業(yè)人才設計與技能大賽"

近日，Altium宣布將為2010年“全國電子專業(yè)人才設計與技能大賽”提供Altium Designer設計軟件及全程培訓輔導。此次Altium與工信部人才交流中心的戰(zhàn)略合作旨在為培養(yǎng)電子行業(yè)的創(chuàng)新型專業(yè)人才提供最先進的技術(shù)和最好的

工業(yè)控制
2010-03-23

電子工信部大賽 ALTIUM
PCB設計為何需要3D功能？ 3D設計好處與挑戰(zhàn)分析

設計和建造下一代電子產(chǎn)品是一個復雜的過程，特別是電子行業(yè)這樣一個全球高度競爭的行業(yè)，在這個行業(yè)中快速而持續(xù)的技術(shù)變革已成為一件普通的事情和創(chuàng)新規(guī)則。如果設計者不能接受這些變化，就會面臨被競爭對手甩在身

工業(yè)控制
2013-05-24

元器件 PCB設計 3D模型 3D設計
基于FPGA的光纖通信系統(tǒng)的設計與實現(xiàn)

摘要：光纖通信是現(xiàn)今數(shù)據(jù)通信系統(tǒng)的主要通信方式，其性能的好壞直接影響數(shù)據(jù)通信系統(tǒng)的質(zhì)量。本文采用Verilog語言實現(xiàn)FPGA光纖通信系統(tǒng)的功能。光纖通信系統(tǒng)又包含位同步時鐘提取模塊、8B／10B編解碼器模塊和NRZI編

工業(yè)控制
2012-05-24

仿真光纖通信系統(tǒng) FPGA 位同步時鐘
時序分析的一些基本概念

時序分析時FPGA設計中永恒的話題，也是FPGA開發(fā)人員設計進階的必由之路。慢慢來，先介紹時序分析中的一些基本概念。

工業(yè)控制
2017-03-06

時序 FPGA
FPGA協(xié)處理技術(shù)介紹及進展

FPGA協(xié)處理技術(shù)介紹及進展FPGA的架構(gòu)使得許多算法得以實現(xiàn)，較之采用四核CPU或通用圖形處理器(GPGPU)，這些算法的持續(xù)性能更接近器件的峰值性能。隨著對芯片、算法和庫基礎(chǔ)的集中改進，F(xiàn)PGA加速器的基準測試結(jié)果不斷

工業(yè)控制
2010-04-28

CPU 帶寬時鐘 FPGA
柔性電路板到底有何優(yōu)勢？3年后市場規(guī)模居然這么高

近年來，柔性電路板（FPC）成為印刷電路板行業(yè)增長最快的子行業(yè)之一。據(jù)IDTechEx公司預測，到2020年，柔性電路板（FPC）的市場規(guī)模將增長到262億美元。上達電子（深圳）股份有限公司（836298）董事長李曉華在日前接受信息時報記者采訪時表示，今年上達電子將加深與華星光電的合作，為柔性電路板（FPC）爆發(fā)期的到來做好準備。

工業(yè)控制
2017-01-18

電路板 fpc 印刷電路板
前仿真和后仿真

作者：李秋鳳，華清遠見嵌入式學院講師。仿真可以分為前仿真和后仿真，前仿真是功能仿真，目標是分析電路的邏輯關(guān)系的正確性，仿真速度快，可以根據(jù)需要觀察電路輸入輸出端口和電路內(nèi)部任一信號和寄存器的波形，后

工業(yè)控制
2018-06-05
形成干擾的原因以及電路板抗干擾如何設計

抗干擾設計的基本任務是系統(tǒng)或裝置既不因外界電磁干擾影響而誤動作或喪失功能，也不向外界發(fā)送過大的噪聲干擾，以免影響其他系統(tǒng)或裝置正常工作。因此提高系統(tǒng)的抗干擾能力也是該系統(tǒng)設計的一個重要環(huán)節(jié)。

工業(yè)控制
2017-12-25

電路板抗干擾設計
基于FPGA實現(xiàn)異步串行通信

摘要：為了適應全數(shù)字化自動控制更加廣泛的應用，采用現(xiàn)場可編程門陣列(FPGA)對異步串行通信控制器(UART)進行多模塊的系統(tǒng)設計的方法，使串口通信的集成度更高。對UART系統(tǒng)結(jié)構(gòu)進行了模塊化分解，可分為三個模塊：FP

工業(yè)控制
2013-10-23

異步串行通信 FPGA實現(xiàn) 波特率發(fā)生器 BSP
利用C語言對FPGA計算解決方案進行編程方法介紹

硬件設計者已經(jīng)開始在高性能DSP的設計中采用FPGA技術(shù)，因為它可以提供比基于PC或者單片機的解決方法快上10-100倍的運算量。以前，對硬件設計不熟悉的軟件開發(fā)者們很難發(fā)揮出FPGA的優(yōu)勢，而如今基于C語言的方法可以讓

工業(yè)控制
2012-04-25

時鐘 C語言編程方法 FPGA
Xilinx ZC706嵌入式開發(fā)和Petalinux小試

Xilinx的開發(fā)環(huán)境我還是推薦Linux（這里默認都是64bit系統(tǒng)），Windows的綜合和P&R的效率要比Linux低三分之一，這個不能忍，再就是petalinux的交叉編譯用啥呢，cygwin？

工業(yè)控制
2017-02-09

Xilinx petalinux
基于FPGA的160路數(shù)據(jù)采集系統(tǒng)設計

目前，數(shù)據(jù)采集系統(tǒng)對采樣率、分辨率和抗干擾能力的要求越來越高。尤其是在典型的多路采集+多路開關(guān)+單路A／D轉(zhuǎn)換器的數(shù)據(jù)采集中，采集速度受到限制。為此，介紹了一種基于現(xiàn)場可編程門陣列(FPGA)的高速多路數(shù)據(jù)采集系統(tǒng)設計和實現(xiàn)。采用模擬開關(guān)級聯(lián)的方法，有效地達到了160路采集速度。采用該方法設計的采集卡能有效完成多路同步高速數(shù)據(jù)采集任務，且成功地用于某裝置的輸出信號檢測。

工業(yè)控制
2009-01-04

系統(tǒng)設計數(shù)據(jù)采集系統(tǒng) FPGA BSP
基于FPGA的DDC設計及仿真

摘要：在軟件無線電數(shù)字接收機中，從AD前端采集過來的數(shù)字信號頻率高達72 MHz，如此高的頻率使得后端DSP不能直接完成相關(guān)的數(shù)字信號處理任務。因此合理的設計基于FPGA的DDC，以降低數(shù)字信號頻率，方便后端DSP實時完成

工業(yè)控制
2012-08-02

仿真 DC C設計 FPGA
基于DSP+FPGA汽車防撞報警設備高速數(shù)據(jù)采集

隨著人們生活水平的提高，公路上的私家車輛也增多了，但隨之帶來的問題就是交通事故發(fā)生率居高不下，嚴重危害著人們的生命安全。文中就如何預防交通事故發(fā)生，研究設計一種響應迅速、高可靠性并且經(jīng)濟實用的汽車防擅

工業(yè)控制
2013-03-01

DSP 汽車防撞高速數(shù)據(jù)采集 FPGA