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基于DSP和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
1 引言 數(shù)據(jù)采集系統(tǒng)是通信與信息技術(shù)領(lǐng)域中重要的功能模塊，應(yīng)用廣泛。而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)大多以單片機(jī)或中規(guī)模數(shù)字電路為核心，其模數(shù)轉(zhuǎn)換器(A／D轉(zhuǎn)換器)采樣速率較低。顯然傳統(tǒng)數(shù)據(jù)采集系統(tǒng)不能完全滿足高速
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基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
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基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
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基于DSP的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案
摘要：設(shè)計(jì)了一種高速數(shù)據(jù)采集系統(tǒng)，采用TMS320F2812 型號(hào)的DSP 和MAX1308 型號(hào)的AD 轉(zhuǎn)換器完成對(duì)8 路同步信號(hào)的采集，通過USB 接口芯片CH372 將采集到的數(shù)據(jù)實(shí)時(shí)傳輸給計(jì)算機(jī)，計(jì)算機(jī)對(duì)整個(gè)數(shù)據(jù)采集過程進(jìn)行控制并顯
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基于DSP的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案
基于DSP的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案
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基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)
為了提高數(shù)據(jù)采集卡的速度，同時(shí)降低成本，設(shè)計(jì)一種并行數(shù)據(jù)采集系統(tǒng)，要求并行采集速度大于10 Mb／s。整個(gè)系統(tǒng)由AVR與CPLD控制實(shí)現(xiàn)，通過MAXl308完成模數(shù)轉(zhuǎn)換，并設(shè)計(jì)搭建了其外圍電路。采用12路數(shù)據(jù)存儲(chǔ)模式存儲(chǔ)高速采集的數(shù)據(jù)。實(shí)驗(yàn)依據(jù)存儲(chǔ)要求搭建硬件電路并調(diào)試，示波器顯示的波形結(jié)果8組脈沖序列完全對(duì)齊，沒有出現(xiàn)時(shí)序混亂，同時(shí)并行處理過程中不相互影響，實(shí)現(xiàn)了低成本高速多路采集的設(shè)計(jì)要求。
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基于LabVIEW的USB接口多路高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
引言 在日常的測(cè)試測(cè)量中，經(jīng)常使用數(shù)據(jù)采集卡采集數(shù)據(jù)。但是很多數(shù)據(jù)采集卡往往通過PCI總線完成數(shù)據(jù)的傳輸，它有諸多弊端，例如操作不便，受限于計(jì)算機(jī)插槽數(shù)量和中斷資源，現(xiàn)場(chǎng)信號(hào)對(duì)計(jì)算機(jī)安全有威脅，計(jì)算機(jī)
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基于LABVIEW的USB接口多路高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
引言 在日常的測(cè)試測(cè)量中，經(jīng)常使用數(shù)據(jù)采集卡采集數(shù)據(jù)。但是很多數(shù)據(jù)采集卡往往通過PCI總線完成數(shù)據(jù)的傳輸，它有諸多弊端，例如操作不便，受限于計(jì)算機(jī)插槽數(shù)量和中斷資源，現(xiàn)場(chǎng)信號(hào)對(duì)計(jì)算機(jī)安全有威脅，計(jì)算機(jī)
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基于增強(qiáng)并行口EPP的便攜式高速數(shù)據(jù)采集系統(tǒng)
基于增強(qiáng)并行口EPP的便攜式高速數(shù)據(jù)采集系統(tǒng)
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基于SOPC的高速數(shù)據(jù)采集系統(tǒng)的分析與設(shè)計(jì)
本文介紹了一種基于SOPC和USB2.0接口的高速數(shù)據(jù)采集系統(tǒng)及其虛擬儀器的設(shè)計(jì)方法。實(shí)驗(yàn)表明，基于本設(shè)計(jì)的高速數(shù)據(jù)采集系統(tǒng)具有抗干擾、可靠性高、失碼率低等優(yōu)點(diǎn)。
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基于SOPC的高速數(shù)據(jù)采集系統(tǒng)的分析與設(shè)計(jì)
本文介紹了一種基于SOPC和USB2.0接口的高速數(shù)據(jù)采集系統(tǒng)及其虛擬儀器的設(shè)計(jì)方法。實(shí)驗(yàn)表明，基于本設(shè)計(jì)的高速數(shù)據(jù)采集系統(tǒng)具有抗干擾、可靠性高、失碼率低等優(yōu)點(diǎn)。
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基于SOPC的高速數(shù)據(jù)采集系統(tǒng)的分析與設(shè)計(jì)
基于SOPC的高速數(shù)據(jù)采集系統(tǒng)的分析與設(shè)計(jì)
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基于TMS320C6713和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
1 引言 數(shù)據(jù)采集系統(tǒng)是通信與信息技術(shù)領(lǐng)域中重要的功能模塊，應(yīng)用廣泛。而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)大多以單片機(jī)或中規(guī)模數(shù)字電路為核心，其模數(shù)轉(zhuǎn)換器(A／D轉(zhuǎn)換器)采樣速率較低。顯然傳統(tǒng)數(shù)據(jù)采集系統(tǒng)不能完全滿足高
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基于TMS320C6713和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
基于TMS320C6713和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
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基于FPGA和USB2．0的高速數(shù)據(jù)采集系統(tǒng)
USB是近年來在計(jì)算機(jī)領(lǐng)域日益流行的一種總線形式。在數(shù)據(jù)采集領(lǐng)域，基于FPGA和USB2．0的數(shù)據(jù)采集系統(tǒng)不但具有速度快、易擴(kuò)展等特點(diǎn)，而且憑借即插即用的功能，適用于更廣泛的應(yīng)用場(chǎng)合。本文介紹了數(shù)據(jù)采集與傳輸系統(tǒng)的工作原理。硬件部分，給出了各模塊的內(nèi)部結(jié)構(gòu)設(shè)計(jì)，以及FPGA內(nèi)部各個(gè)功能模塊的設(shè)計(jì)思路和具體實(shí)現(xiàn)過程；軟件部分，給出了系統(tǒng)的軟件結(jié)構(gòu)，以及固件程序流程。
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基于CPLD／FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
針對(duì)傳統(tǒng)數(shù)據(jù)采集與處理系統(tǒng)存在運(yùn)算能力差，擴(kuò)展難度大等缺點(diǎn)，采用CPLD／FPGA可編程邏輯器件、ARM32位嵌入式微處理器、FIFO存儲(chǔ)器、USB接口設(shè)計(jì)多功能的高速數(shù)據(jù)采集系統(tǒng)，并設(shè)計(jì)出系統(tǒng)硬件結(jié)構(gòu)和軟件流程。該系統(tǒng)可實(shí)現(xiàn)對(duì)各種模擬信號(hào)的數(shù)據(jù)采集和處理，實(shí)用性強(qiáng)，可靠性高，編程靈活，數(shù)據(jù)采集和傳輸速度快，具有很好的應(yīng)用和發(fā)展前景。
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基于窄脈沖反射儀的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
摘要：簡(jiǎn)單介紹了窄脈沖反射儀測(cè)試電纜故障的基本原理，分析了其脈沖的特點(diǎn)和處理要求，設(shè)計(jì)了單路低速多次數(shù)據(jù)采集系統(tǒng)，給出了系統(tǒng)原理框圖，并對(duì)其邏輯控制部分做了詳細(xì)闡述。通過仿真分析，證明該系統(tǒng)方案切實(shí)可
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基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
在ARM微處理器中移入嵌入式實(shí)時(shí)操作系統(tǒng)μC/OS-II，使系統(tǒng)的穩(wěn)定性、實(shí)時(shí)性得到保證，實(shí)時(shí)操作系統(tǒng)將應(yīng)用分解成多任務(wù)，簡(jiǎn)化了應(yīng)用系統(tǒng)軟件的設(shè)計(jì)；采用CPLD器件集成了電路的全部控制功能，擺脫了單純用由微控制器為核心的數(shù)據(jù)采集系統(tǒng)時(shí)的速度瓶頸，極大提高了數(shù)據(jù)采集速度。整個(gè)系統(tǒng)具有速度高、實(shí)時(shí)性好、抗干擾能力強(qiáng)、性價(jià)比高等特點(diǎn)。
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基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
在ARM微處理器中移入嵌入式實(shí)時(shí)操作系統(tǒng)μC/OS-II，使系統(tǒng)的穩(wěn)定性、實(shí)時(shí)性得到保證，實(shí)時(shí)操作系統(tǒng)將應(yīng)用分解成多任務(wù)，簡(jiǎn)化了應(yīng)用系統(tǒng)軟件的設(shè)計(jì)；采用CPLD器件集成了電路的全部控制功能，擺脫了單純用由微控制器為核心的數(shù)據(jù)采集系統(tǒng)時(shí)的速度瓶頸，極大提高了數(shù)據(jù)采集速度。整個(gè)系統(tǒng)具有速度高、實(shí)時(shí)性好、抗干擾能力強(qiáng)、性價(jià)比高等特點(diǎn)。
