在驗證中采用最新技術(shù)的缺點！

時間：2021-12-08 17:29:41

關(guān)鍵字： BUG EDA VERILOG 編程語言

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[導讀]“驗證很多人都清楚，驗證技術(shù)一直在發(fā)展，個人技術(shù)成長不進則退。于是采用最新的驗證方法和趨勢是很多驗證牛人趨之若鶩的事情。一旦驗證大佬嘗試了某個事情，可能很快就會在團隊傳播起來，這就是偶像效應。這時候，這項技術(shù)仿佛就是經(jīng)過檢驗了的真理，也不管實際的應用場景和根本邏輯了。這些新技術(shù)包...

“驗證”

很多人都清楚，驗證技術(shù)一直在發(fā)展，個人技術(shù)成長不進則退。于是采用最新的驗證方法和趨勢是很多驗證牛人趨之若鶩的事情。

一旦驗證大佬嘗試了某個事情，可能很快就會在團隊傳播起來，這就是偶像效應。這時候，這項技術(shù)仿佛就是經(jīng)過檢驗了的真理，也不管實際的應用場景和根本邏輯了。

這些新技術(shù)包括，新的工具、方法學、程序語言等等。這些新技術(shù)的采用最初都是為了提高生產(chǎn)力，發(fā)現(xiàn)更多bug或者使得測試平臺更好地維護和復用。

對新技術(shù)的追求可以讓你隨時了解市場的新趨勢，并成為采用新技術(shù)的先行者。

但是，我們可能還需要評估下肆意追求新技術(shù)所帶來的不利方面。

1、編程語言的新特性可能僅僅是當前語言的微小增強。EDA工具可能不會對這些特性做很好的支持。比如說Verilog，仿真工具、形式驗證工具、linting工具、綜合工具、APR工具都需要支持，任何一個缺少支持都會給整個IC研發(fā)周期造成不小的麻煩。

2、并非所有人都和你一樣期待使用新的技術(shù)，大多數(shù)人都很難適應變化。