FPGA
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一種基于FPGA的DDR SDRAM控制器的設(shè)計
摘要 對DDR SDRAM的基本工作特性以及時序進行了分析與研究，基于FPGA提出了一種通用的DDRSDRAM控制器設(shè)計方案。在Modelaim上通過了軟件功能仿真，并在FPGA芯片上完成了硬件驗證。結(jié)果表明，該控制器能夠較好地完成DD
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14nm將改變可編程市場游戲規(guī)則
近年來，F(xiàn)PGA應(yīng)用需求與日俱增，不論是無線通訊基礎(chǔ)設(shè)備、工控自動化、連網(wǎng)汽車、醫(yī)療成像以及航太軍事等嵌入式應(yīng)用領(lǐng)域，都相當(dāng)需要FPGA的可編程邏輯組合實現(xiàn)各種功能。為了替各種不同應(yīng)用需求量身訂制所需產(chǎn)品，A
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基于FPGA的自定義總線MCMB的設(shè)計與實現(xiàn)
摘要：針對現(xiàn)在對機載數(shù)據(jù)采集系統(tǒng)中總線技術(shù)的要求，采用Altera公司的CycloneIII系列FPGA EP3C40F484，在數(shù)據(jù)采集系統(tǒng)中實現(xiàn)了自定義數(shù)據(jù)采集總線MCMB的設(shè)計。通過Modelsim進行功能仿真，并利用QuartusⅡ自帶的仿真
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基于FPGA的視頻采集顯示系統(tǒng)
摘要 設(shè)計實現(xiàn)一種基于FPGA的視頻采集顯示系統(tǒng)，包括視頻圖像的采集、處理與顯示3個部分。視頻圖像部分采用CCD攝像頭OV7670作為視頻數(shù)據(jù)的采集，利用在FPGA中構(gòu)建FIFO并配合SDRAM高速讀寫實現(xiàn)視頻圖像數(shù)據(jù)的高速緩存
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聲導(dǎo)航自行小車研究
摘要 采用特定頻率的聲音信號作為聲源對小車進行導(dǎo)航，使小車能夠通過接收和處理聲信號以確定聲源方向和位置，并行進至聲源處的功能。其中，用硬件濾波電路對聲信號進行濾波處理，由FPGA計算聲信號到達的時間差，單片
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基于DSP+FPGA的多相變頻控制器設(shè)計
在電機驅(qū)動系統(tǒng)應(yīng)用中，多相電機驅(qū)動系統(tǒng)可以應(yīng)用在供電電壓受限制的場合，其作用是：(1)解決低壓大功率的問題;(2)減小振動和噪音。由于電機相數(shù)增加，輸出轉(zhuǎn)矩脈動減小、脈動頻率增加，使驅(qū)動系統(tǒng)低速特性得到很大的
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基于FPGA的UART 16倍頻采樣的VHDL設(shè)計
概述隨著電子設(shè)計自動化(EDA)技術(shù)的發(fā)展，可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用，而UART(通用異步收發(fā)器) 是在數(shù)字通信和控制系統(tǒng)中廣泛使用的串行數(shù)據(jù)傳輸協(xié)議。因此越來越多用戶根據(jù)自己的需要，以
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盡己之事 賽靈思明確FPGA未來市場定位
與28nm的追逐戰(zhàn)不同，當(dāng)Altera一邊廂大力推進其基于下一代工藝的產(chǎn)品系列時，賽靈思并沒有馬上跟進或很激進的開始火拼之勢，而是淡定的盡己之事，為自己的FPGA產(chǎn)品做很好的未來市場定位，打造一種理念。我們知道賽靈
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一種基于FPGA的實時紅外圖像預(yù)處理方法
摘要：由于紅外圖像預(yù)處理算法自身的復(fù)雜性，使得紅外圖像在DSP中的預(yù)處理時間較長。針對這一問題，提出一種基于FPGA的實時紅外圖像預(yù)處理方法。該方法采用了流水線技術(shù)來并行完成非均勻校正、空間濾波、直方圖統(tǒng)計等
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ADI公司舉辦2013設(shè)計峰會
Analog Devices, Inc.與Xilinx® Inc.和MathWorks Inc.將合作舉辦一系列面向模擬、混合信號和嵌入式系統(tǒng)工程師的設(shè)計會議。會議的主題是“Discuss. Design. Deliver.”，高性能模擬、現(xiàn)場可編程門陣列
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基于Xilinx FPGA的部分動態(tài)可重構(gòu)技術(shù)的信號解調(diào)系統(tǒng)
隨著現(xiàn)代通信技術(shù)的迅速發(fā)展，信號的調(diào)制方式向多樣化發(fā)展，解淵技術(shù)也隨之不斷向前發(fā)展。為了對高速大帶寬的信號進行實時解調(diào)，現(xiàn)在很多的解調(diào)關(guān)鍵算法都是在高速硬件上用可編程邏輯器件(FPGA)實觀，利用FPGA強大的
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ADI公司舉辦2013設(shè)計峰會
Analog Devices, Inc.(NASDAQ：ADI)與Xilinx Inc.和MathWorks Inc.將合作舉辦一系列面向模擬、混合信號和嵌入式系統(tǒng)工程師的設(shè)計會議。會議的主題是“Discuss. Design. Deliver.”，高性能模擬、現(xiàn)場可編程
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賽靈思及生態(tài)伙伴NAB 2013展示十項更智能專業(yè)廣播系統(tǒng)
賽靈思公司 (Xilinx, Inc. )及其生態(tài)系統(tǒng)企業(yè)日前在2013年美國廣播電視設(shè)備展覽會(NAB 2013)上展示先進的All Programmable和更智能專業(yè)廣播系統(tǒng)。這些系統(tǒng)都是采用賽靈思的解決方案專門針對視頻和Smarter Vision應(yīng)用
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Altera展示首款QPI 1.1 FPGA本地代理 增強服務(wù)器功能
近日，Altera公司在業(yè)界首次展示Intel QuickPath互聯(lián)(QPI)協(xié)議1.1支持的FPGA本地代理(Home Agent)。與Intel的Sandy Bridge XEON處理器相連接，這一演示在Pactron Vigor開發(fā)平臺上采用了Altera Stratix V FPGA，它被配
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基于ISE設(shè)計提供低功耗FPGA解決方案
從Xilinx公司推出FPGA二十多年來，研發(fā)工作大大提高了FPGA的速度和面積效率，縮小了FPGA與ASIC之間的差距，使FPGA成為實現(xiàn)數(shù)字電路的優(yōu)選平臺。今天，功耗日益成為FPGA供應(yīng)商及其客戶關(guān)注的問題。降低FPGA功耗是降低
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基于FPGA的雙備份多路數(shù)據(jù)采集存儲系統(tǒng)的設(shè)計與實現(xiàn)
隨著信息技術(shù)的發(fā)展以及數(shù)字集成電路速度的提高，實時處理大量數(shù)據(jù)已經(jīng)成為現(xiàn)實，但在一些特殊條件下，無法實時傳輸數(shù)據(jù)，必須使用存儲測試方法。該方法是在不影響被測對象或在允許的范圍下，將微型存儲測試系統(tǒng)置入
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Altera展示業(yè)界第一款QPI 1.1 FPGA本地代理
21ic訊 Altera公司日期宣布，在業(yè)界首次展示Intel QuickPath互聯(lián)(QPI)協(xié)議1.1支持的FPGA本地代理(Home Agent)。與Intel的Sandy Bridge XEON處理器相連接，這一演示在Pactron Vigor開發(fā)平臺上采用了Altera® Str
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Altera展示32-Gbps收發(fā)器 20nm FPGA早期使用計劃成功
近日，Altera公司公司展出了業(yè)界首款具有32-Gbps收發(fā)器功能的可編程器件，在收發(fā)器技術(shù)上樹立了另一關(guān)鍵里程碑，表明Altera 20 nm FPGA早期使用計劃最近又獲得成功。此次展示使用了基于TSMC 20SoC工藝技術(shù)的20 nm器
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Cadence和TSMC為16納米FinFET開發(fā)設(shè)計架構(gòu)
Cadence設(shè)計系統(tǒng)公司4月9日宣布與TSMC簽訂了一項長期合作協(xié)議，共同開發(fā)16納米FinFET技術(shù)，以其適用于移動、網(wǎng)絡(luò)、服務(wù)器和FPGA等諸多應(yīng)用領(lǐng)域。此次合作非常深入，開始于工藝制造的早期階段，貫穿于設(shè)計分析至設(shè)計簽
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FPGA與CPLD的區(qū)別有哪些？
盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點:①CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
