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  • 地線上不必要的電壓為什么會(huì)出現(xiàn)地彈

    圖2.16描繪了一個(gè)理想邏輯器件管芯引線連接的四引腳雙列直插式封裝器件。包含一個(gè)發(fā)送電路和一個(gè)電路。發(fā)送電路是推拉輸出電路，而事實(shí)上任何構(gòu)造的電路在高速情況下都同樣會(huì)出現(xiàn)這一問(wèn)題。假定輸出驅(qū)動(dòng)器的開關(guān)B剛剛

  • 電壓容限原理及其它介紹

    電壓容限是邏輯驅(qū)動(dòng)器的保證輸出與邏輯接收器在最壞的情況下的靈敏度之間的差值。工作基于接收電壓的邏輯系列產(chǎn)品都有電壓容限，如同光學(xué)邏輯器件有光子容限，或者機(jī)械設(shè)備在BABBAGE引擎中有機(jī)械聯(lián)運(yùn)容限一樣。圖2.1

  • 電壓突變的影響--DV/DT以及電流突變的影響--DL/DT

    數(shù)字信號(hào)主要的頻率分量都位于它的轉(zhuǎn)折頻率以下。轉(zhuǎn)折頻率FKNEE與脈沖上升時(shí)間TR相關(guān)，而與傳播延遲、時(shí)鐘速率或轉(zhuǎn)換頻率無(wú)關(guān)：信號(hào)傳播的整個(gè)路徑，包括器件封裝、電路板布局以及連接器等，如果要它們正確地分發(fā)轉(zhuǎn)換

  • 邏輯門電路的傳播速度

    理論上的數(shù)字邏輯設(shè)計(jì)重點(diǎn)關(guān)注的是邏輯門電路的傳播延遲。相比之下，高頻電子工程中的許多實(shí)際的問(wèn)題通常只取決于一個(gè)更細(xì)微的指標(biāo)：最小輸出轉(zhuǎn)換時(shí)間。圖2.13舉例說(shuō)明了這一差別。較快的轉(zhuǎn)換時(shí)間會(huì)導(dǎo)致返回電流，串

  • 輸出功耗原理與計(jì)算

    消耗在端接電阻、下拉電阻以及其他偏置電阻上的功率使得電源總功率的負(fù)荷增加了，同時(shí)還增加了冷卻的要求?！隘B加偏置電流產(chǎn)生的動(dòng)態(tài)功耗”文中解決了電路驅(qū)動(dòng)外部負(fù)載的功耗問(wèn)題。這一節(jié)將計(jì)算那些消耗在負(fù)載上的功

  • 電流源輸出電路的功耗

    電流源輸出電路具有線性的優(yōu)勢(shì)，通常在一些專門的總路線應(yīng)用中采用。當(dāng)驅(qū)動(dòng)一個(gè)長(zhǎng)的總線時(shí)，其電流輸出自然而然地相互疊加，與電壓源輸出中非線性方式的相互影響形成鮮明對(duì)比。由于這些電路被設(shè)計(jì)線性甲類放大器，驅(qū)

  • TTL或CMOS集電極開路輸出的功耗

    用來(lái)計(jì)算TTL集電極開路輸出電路靜態(tài)功耗的公式如下：其中：VT=上拉電阻的有效端接電壓 R=端接電阻的有效值 VHI=高電平輸出（通常等于VT） VLO=低電平輸出 VEE=輸出晶體管的射極（或源極

  • 射極跟隨器輸出電路的靜態(tài)功耗

    圖2.9舉例說(shuō)明了一個(gè)ECL或GAAS射極跟隨器輸出電路。該電路在HI和LO兩個(gè)狀態(tài)都有電流流過(guò)。對(duì)于10KH和10G產(chǎn)品系列，兩者的邏輯HI和LO輸出電壓都是相近的，盡管不同的ECL和GAAS射極耦合邏輯系列在溫度軌跡特性上存在細(xì)

  • 如何用EL34制作的合并式電子管功放

    在通用底板上先將各種開關(guān)、電位器、接線支架、輸入與輸出接線端子、電子管燈座等小零件逐一裝上，陶瓷燈座在安裝時(shí)必須注意圖示方位，這樣可以保持接線距離最近。其中電源變壓器，左、右聲道輸出變壓器由于

  • 推拉輸出電路的動(dòng)態(tài)功耗

    設(shè)計(jì)者經(jīng)常僅僅根據(jù)所接負(fù)載的直流輸入電流要求，冒險(xiǎn)使推拉輸出電路的負(fù)載達(dá)到它的最大直流扇出能力。特別是當(dāng)設(shè)計(jì)CMOS總線時(shí)這一想法尤其具有誘惑力，因?yàn)榇藭r(shí)理論上的扇出能力是無(wú)限的。實(shí)際上重負(fù)載的總路線結(jié)構(gòu)

  • 推拉輸出電路中的靜態(tài)功耗

    一旦推拉輸出電路完全轉(zhuǎn)換，靜態(tài)功耗等于源電流乘以導(dǎo)通臂上的剩余電壓。我們將分別計(jì)算出LO和HI狀態(tài)下的功率，然后取二者的平均值。圖2.6說(shuō)明了理想的TT驅(qū)動(dòng)器在LO和HI狀態(tài)下的功耗。對(duì)于標(biāo)準(zhǔn)的TTL器件，Q2處于飽和

  • 內(nèi)部電源用于邏輯器件的內(nèi)部功率

    內(nèi)部電源用于邏輯器件內(nèi)部節(jié)點(diǎn)的偏置和轉(zhuǎn)換。內(nèi)部功率包括靜態(tài)功耗和動(dòng)態(tài)功耗。靜態(tài)內(nèi)部功耗的定義是在無(wú)負(fù)載連接、輸入端處于隨機(jī)狀態(tài)的條件下的功耗求出所有可能的輸入狀態(tài)的平均值可以得到靜態(tài)功耗。內(nèi)部動(dòng)態(tài)功耗

  • 芯片如何輸入功率

    芯片的輸入功率來(lái)自于其他器件。對(duì)于輸入電路的偏置和觸發(fā)來(lái)說(shuō)它是必需的。表2.1比較了4種不同邏輯系列的靜態(tài)和動(dòng)態(tài)輸入特性，4種邏輯系列為：SIONETICS 74HCT CMOS，TEXAS INSTRUMENTS 74AS TTL，MOTOROLA 10KH ECL

  • 疊加偏置電流產(chǎn)生的動(dòng)態(tài)功耗

    在圖中2.1中，TTL反相順的輸出驅(qū)動(dòng)電路在HI和LO之間交替轉(zhuǎn)換，Q1或Q2交替處于導(dǎo)通狀態(tài)，而不是兩者同時(shí)導(dǎo)通。這種電路配置有兩個(gè)激勵(lì)電路，一個(gè)把輸出電壓上拉到HI，而另外一個(gè)把輸出電壓下拉到LO，通常稱之為推拉輸

  • 驅(qū)動(dòng)容性負(fù)載的動(dòng)態(tài)功耗

    邏輯電路每一次跳變，都要消耗超過(guò)它正常靜態(tài)功耗之外的額外的額外功率。當(dāng)以一個(gè)恒定速率循環(huán)時(shí)，動(dòng)態(tài)功耗等于功耗=周期頻率*每個(gè)周期額外的功率動(dòng)態(tài)功耗最常見的兩個(gè)起因是負(fù)載電容和疊加的偏置電流。圖2.2說(shuō)明了驅(qū)

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