FPGA
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基于FPGA的圖像預(yù)處理系統(tǒng)
本文介紹的是利用FPGA并行處理和計(jì)算能力，以Altera FPGA Stratix EP1S40為系統(tǒng)控制的核心實(shí)現(xiàn)的SOPC。
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DAB接收機(jī)的樣機(jī)設(shè)計(jì)
由于手機(jī)電視將為2008北京奧運(yùn)提供服務(wù)，國(guó)內(nèi)多家單位已積極致力于DAB的研制開發(fā)。本文將介紹DAB接收機(jī)的樣機(jī)設(shè)計(jì)。
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DAB接收機(jī)的樣機(jī)設(shè)計(jì)
由于手機(jī)電視將為2008北京奧運(yùn)提供服務(wù)，國(guó)內(nèi)多家單位已積極致力于DAB的研制開發(fā)。本文將介紹DAB接收機(jī)的樣機(jī)設(shè)計(jì)。
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賽靈思加速低成本FPGA向大批量應(yīng)用滲透
在會(huì)上，我們了解到Spartan™-3A系列這一平臺(tái)是對(duì)低成本、大規(guī)模應(yīng)用的新一代Spartan-3系列產(chǎn)品的擴(kuò)展。Spartan-3A平臺(tái)為相對(duì)于邏輯密度而言更注重I/O數(shù)量與功能的應(yīng)用提供了一個(gè)成本更低的解決方案。隨著I/O優(yōu)化的Spartan-3A平臺(tái)的推出， 新一代Spartan-3系列器件將能夠更好地滿足家庭、汽車以及工廠環(huán)境中的“網(wǎng)絡(luò)邊緣”應(yīng)用需求，從而加快了低成本FPGA向全球數(shù)十億美元的大規(guī)模應(yīng)用市場(chǎng)的進(jìn)一步滲透。到目前為止，Spartan產(chǎn)品線已經(jīng)占到賽靈思公司總收入的26％。自從Spartan產(chǎn)品線啟動(dòng)以來(lái)，出貨量已達(dá)2億個(gè)器件，達(dá)到18億美元的銷售收入。
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賽靈思90nm FPGA平臺(tái)出貨量達(dá)2600萬(wàn)片
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Xilinx 發(fā)布SPARTAN-3A FPGA平臺(tái)
賽靈思公司（Xilinx）今日宣布推出Spartan™-3A系列I/O優(yōu)化現(xiàn)場(chǎng)可編程門陣列（FPGA）平臺(tái)。
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基于FPGA的DDS調(diào)頻信號(hào)的研究與實(shí)現(xiàn)
直接數(shù)字頻率合成器（DDS）技術(shù)，具有頻率切換速度快，很容易提高頻率分辨率、對(duì)硬件要求低、可編程全數(shù)字化便于單片集成、有利于降低成本、提高可靠性并便于生產(chǎn)等優(yōu)點(diǎn)。
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也發(fā)我的面試經(jīng)歷--2007中興
中興的那個(gè)面試官素質(zhì)真的沒(méi)話說(shuō)，感覺(jué)跟你是他仇人一樣。
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基于DSP＋FPGA的便攜數(shù)字存儲(chǔ)示波表設(shè)計(jì)
本文提出了一種基于DSP＋FPGA的嵌入式便攜數(shù)字存儲(chǔ)示波表的設(shè)計(jì)方案，充分利用微控制器技術(shù)和ASIC技術(shù)實(shí)現(xiàn)了嵌入式實(shí)時(shí)處理，很好地達(dá)到了體積小、重量輕、功能強(qiáng)、可靠性高的要求。
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使用FPGA和IP Core實(shí)現(xiàn)定制緩沖管理
在通信網(wǎng)絡(luò)系統(tǒng)中，流量管理的核心是緩存管理、隊(duì)列管理和調(diào)度程序。本文結(jié)合使用FPGA及IP Core闡述緩存管理的結(jié)構(gòu)、工作原理及設(shè)計(jì)方法。
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基于DSP＋FPGA的便攜數(shù)字存儲(chǔ)示波表設(shè)計(jì)
本文提出了一種基于DSP＋FPGA的嵌入式便攜數(shù)字存儲(chǔ)示波表的設(shè)計(jì)方案，充分利用微控制器技術(shù)和ASIC技術(shù)實(shí)現(xiàn)了嵌入式實(shí)時(shí)處理，很好地達(dá)到了體積小、重量輕、功能強(qiáng)、可靠性高的要求。
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MCS-51單片機(jī)與CPLD/FPGA接口邏輯設(shè)計(jì)
本文就單片機(jī)與CPLD/FPGA的接口方式作一簡(jiǎn)單介紹，希望對(duì)從事單片機(jī)和CPLD/FPGA研發(fā)的朋友能有所啟發(fā)。
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使用一個(gè)FPGA便可實(shí)現(xiàn)的64通道下變頻器
RF Engines公司的ChannelCore64使設(shè)計(jì)者能夠用一個(gè)可對(duì)FPGA編程的IP核來(lái)替代多達(dá)16個(gè)DDC(直接下變頻器)ASIC，可顯著減少PCB面積，降低功耗而且增加靈活性。
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基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計(jì)
本文采用DSP+FPGA的方案，由硬件控制A/D轉(zhuǎn)換和數(shù)據(jù)存儲(chǔ)，最大限度地提高系統(tǒng)的信號(hào)采集和處理能力。
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基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計(jì)
本文采用DSP+FPGA的方案，由硬件控制A/D轉(zhuǎn)換和數(shù)據(jù)存儲(chǔ)，最大限度地提高系統(tǒng)的信號(hào)采集和處理能力。
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基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)
本文介紹了一種基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)方法。
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基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)
本文介紹了一種基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)方法。
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基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)
基于FPGA的線陣CCD數(shù)據(jù)采集系統(tǒng)
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Altera 推出Cyclone II FPGA啟動(dòng)套件
Altera公司推出新的低成本Cyclone® II FPGA啟動(dòng)套件，進(jìn)一步簡(jiǎn)化了FPGA設(shè)計(jì)。
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Ports模式下CY7C68013和FPGA的數(shù)據(jù)通信
CY7C68013和FPGA的數(shù)據(jù)通信中，采用基本的Ports接口模式，利用自動(dòng)指針?lè)椒ǎㄟ^(guò)數(shù)字示波器的觀察，完成1KB的傳送，大約需要750μs。
