FPGA
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嵌入式未來的發(fā)展方向[轉(zhuǎn)]
嵌入式未來的發(fā)展方向[轉(zhuǎn)]
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賽靈思VIRTEX-5 FPGA通過v1.1兼容性測試
賽靈思公司( Xilinx, Inc)今天宣布其Virtex™-5 LXT FPGA通過了最新的PCI Express端點 v1.1基本標準兼容性測試認證大會（Compliance Workshop）組織的測試，并且已經(jīng)進入PCI-SIG集成商列表。
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基于FPGA的雷達脈沖壓縮系統(tǒng)設(shè)計
脈沖壓縮技術(shù)是指對雷達發(fā)射的寬脈沖信號進行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼)，并在接收端對回波寬脈沖信號進行脈沖壓縮處理后得到窄脈沖的實現(xiàn)過程。
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基于FPGA的圖像預處理系統(tǒng)
本文介紹的是利用FPGA并行處理和計算能力，以Altera FPGA Stratix EP1S40為系統(tǒng)控制的核心實現(xiàn)的SOPC。
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基于FPGA的雷達脈沖壓縮系統(tǒng)設(shè)計
脈沖壓縮技術(shù)是指對雷達發(fā)射的寬脈沖信號進行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼)，并在接收端對回波寬脈沖信號進行脈沖壓縮處理后得到窄脈沖的實現(xiàn)過程。
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基于FPGA的圖像預處理系統(tǒng)
本文介紹的是利用FPGA并行處理和計算能力，以Altera FPGA Stratix EP1S40為系統(tǒng)控制的核心實現(xiàn)的SOPC。
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DAB接收機的樣機設(shè)計
由于手機電視將為2008北京奧運提供服務(wù)，國內(nèi)多家單位已積極致力于DAB的研制開發(fā)。本文將介紹DAB接收機的樣機設(shè)計。
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DAB接收機的樣機設(shè)計
由于手機電視將為2008北京奧運提供服務(wù)，國內(nèi)多家單位已積極致力于DAB的研制開發(fā)。本文將介紹DAB接收機的樣機設(shè)計。
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賽靈思加速低成本FPGA向大批量應用滲透
在會上，我們了解到Spartan™-3A系列這一平臺是對低成本、大規(guī)模應用的新一代Spartan-3系列產(chǎn)品的擴展。Spartan-3A平臺為相對于邏輯密度而言更注重I/O數(shù)量與功能的應用提供了一個成本更低的解決方案。隨著I/O優(yōu)化的Spartan-3A平臺的推出， 新一代Spartan-3系列器件將能夠更好地滿足家庭、汽車以及工廠環(huán)境中的“網(wǎng)絡(luò)邊緣”應用需求，從而加快了低成本FPGA向全球數(shù)十億美元的大規(guī)模應用市場的進一步滲透。到目前為止，Spartan產(chǎn)品線已經(jīng)占到賽靈思公司總收入的26％。自從Spartan產(chǎn)品線啟動以來，出貨量已達2億個器件，達到18億美元的銷售收入。
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賽靈思90nm FPGA平臺出貨量達2600萬片
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Xilinx 發(fā)布SPARTAN-3A FPGA平臺
賽靈思公司（Xilinx）今日宣布推出Spartan™-3A系列I/O優(yōu)化現(xiàn)場可編程門陣列（FPGA）平臺。
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基于FPGA的DDS調(diào)頻信號的研究與實現(xiàn)
直接數(shù)字頻率合成器（DDS）技術(shù)，具有頻率切換速度快，很容易提高頻率分辨率、對硬件要求低、可編程全數(shù)字化便于單片集成、有利于降低成本、提高可靠性并便于生產(chǎn)等優(yōu)點。
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也發(fā)我的面試經(jīng)歷--2007中興
中興的那個面試官素質(zhì)真的沒話說，感覺跟你是他仇人一樣。
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基于DSP＋FPGA的便攜數(shù)字存儲示波表設(shè)計
本文提出了一種基于DSP＋FPGA的嵌入式便攜數(shù)字存儲示波表的設(shè)計方案，充分利用微控制器技術(shù)和ASIC技術(shù)實現(xiàn)了嵌入式實時處理，很好地達到了體積小、重量輕、功能強、可靠性高的要求。
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使用FPGA和IP Core實現(xiàn)定制緩沖管理
在通信網(wǎng)絡(luò)系統(tǒng)中，流量管理的核心是緩存管理、隊列管理和調(diào)度程序。本文結(jié)合使用FPGA及IP Core闡述緩存管理的結(jié)構(gòu)、工作原理及設(shè)計方法。
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基于DSP＋FPGA的便攜數(shù)字存儲示波表設(shè)計
本文提出了一種基于DSP＋FPGA的嵌入式便攜數(shù)字存儲示波表的設(shè)計方案，充分利用微控制器技術(shù)和ASIC技術(shù)實現(xiàn)了嵌入式實時處理，很好地達到了體積小、重量輕、功能強、可靠性高的要求。
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MCS-51單片機與CPLD/FPGA接口邏輯設(shè)計
本文就單片機與CPLD/FPGA的接口方式作一簡單介紹，希望對從事單片機和CPLD/FPGA研發(fā)的朋友能有所啟發(fā)。
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使用一個FPGA便可實現(xiàn)的64通道下變頻器
RF Engines公司的ChannelCore64使設(shè)計者能夠用一個可對FPGA編程的IP核來替代多達16個DDC(直接下變頻器)ASIC，可顯著減少PCB面積，降低功耗而且增加靈活性。
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基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計
本文采用DSP+FPGA的方案，由硬件控制A/D轉(zhuǎn)換和數(shù)據(jù)存儲，最大限度地提高系統(tǒng)的信號采集和處理能力。
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基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計
本文采用DSP+FPGA的方案，由硬件控制A/D轉(zhuǎn)換和數(shù)據(jù)存儲，最大限度地提高系統(tǒng)的信號采集和處理能力。
