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FPGA

我要報(bào)錯(cuò)
FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。

  • 自動(dòng)生成Verilog代碼的幾種創(chuàng)新方法

    在當(dāng)今快速發(fā)展的硬件設(shè)計(jì)領(lǐng)域，自動(dòng)生成Verilog代碼已成為提高設(shè)計(jì)效率和準(zhǔn)確性的重要手段。Verilog作為一種廣泛應(yīng)用的硬件描述語(yǔ)言（HDL），其代碼自動(dòng)生成技術(shù)可以大大縮短產(chǎn)品開(kāi)發(fā)周期，降低設(shè)計(jì)成本。本文將介紹幾種常用的自動(dòng)生成Verilog代碼的方法，并探討其各自的優(yōu)缺點(diǎn)。

  • AMD 以全球極快的纖薄尺寸電子交易加速卡擴(kuò)展 Alveo 產(chǎn)品組合，助力廣泛且具性?xún)r(jià)比的服務(wù)器部署

    AMD Alveo UL3422 加速卡為高頻交易員在爭(zhēng)奪最快交易執(zhí)行的競(jìng)爭(zhēng)中提供了優(yōu)勢(shì)，同時(shí)降低了進(jìn)入門(mén)檻

  • 從邊緣到云，Altera以可擴(kuò)展產(chǎn)品組合加快FPGA創(chuàng)新

    全新可編程軟硬件和開(kāi)發(fā)工具經(jīng)過(guò)優(yōu)化，可在廣泛的用例中提升開(kāi)發(fā)者工作效率、驅(qū)動(dòng)智能計(jì)算。

  • 應(yīng)用創(chuàng)新 打造新生態(tài) I 2024中國(guó)集成電路設(shè)計(jì)創(chuàng)新大會(huì)暨第四屆IC應(yīng)用展圓滿(mǎn)落幕！

    9月25-27日，由中國(guó)集成電路設(shè)計(jì)創(chuàng)新聯(lián)盟、無(wú)錫國(guó)家高新技術(shù)產(chǎn)業(yè)開(kāi)發(fā)區(qū)管理委員會(huì)、國(guó)家“芯火”雙創(chuàng)基地（平臺(tái)）、芯脈通會(huì)展主辦的“2024中國(guó)集成電路設(shè)計(jì)創(chuàng)新大會(huì)暨第四屆IC應(yīng)用展（ICDIA-IC Show）”在無(wú)錫太湖國(guó)際博覽中心召開(kāi)。

  • 在FPGA或ASICS中實(shí)現(xiàn)浮點(diǎn)算法

    浮點(diǎn)是最受歡迎的數(shù)據(jù)類(lèi)型,可以保證算法建模和仿真的高精度計(jì)算。傳統(tǒng)上,當(dāng)您想將這些浮點(diǎn)算法部署到FPGA或ASIC硬件時(shí),您的唯一選擇是將算法中的每一個(gè)數(shù)據(jù)類(lèi)型轉(zhuǎn)換為固定點(diǎn),以節(jié)約硬件資源并加速計(jì)算。轉(zhuǎn)換到固定點(diǎn)降低了數(shù)學(xué)精度,有時(shí)在轉(zhuǎn)換過(guò)程中在數(shù)據(jù)類(lèi)型的字?jǐn)?shù)長(zhǎng)度和數(shù)學(xué)精度之間實(shí)現(xiàn)正確的平衡是很困難的。對(duì)于需要高動(dòng)態(tài)范圍或高精度的計(jì)算(例如設(shè)計(jì)有反饋環(huán)),定點(diǎn)轉(zhuǎn)換可能需要幾個(gè)星期或幾個(gè)月的工程時(shí)間。另外,為了達(dá)到數(shù)字精確度,設(shè)計(jì)師必須使用大的固定字形。

  • 盤(pán)點(diǎn)FPGA固核、硬核與軟核的區(qū)別

    FPGA(Field-Programmable Gate Array)是一種可編程邏輯器件，可以通過(guò)編程實(shí)現(xiàn)不同的數(shù)字電路功能。固核、軟核和硬核是FPGA(Field-Programmable Gate Array)中常見(jiàn)的IP核形式，F(xiàn)PGA通常包含硬核和軟核兩種處理器。

  • 基于FPGA的8b/10b SERDES接口設(shè)計(jì)：技術(shù)與實(shí)現(xiàn)

    隨著大數(shù)據(jù)和高速通信技術(shù)的飛速發(fā)展，數(shù)據(jù)傳輸對(duì)帶寬和效率的需求日益增加。傳統(tǒng)的并行接口因受限于時(shí)序同步、信號(hào)干擾及設(shè)計(jì)復(fù)雜度等問(wèn)題，逐漸被高速串行接口所取代。其中，基于FPGA的8b/10b SERDES（Serializer-Deserializer）接口設(shè)計(jì)因其高帶寬、低引腳數(shù)及靈活性，成為嵌入式系統(tǒng)和高性能計(jì)算領(lǐng)域的熱門(mén)選擇。本文將深入探討基于FPGA的8b/10b SERDES接口設(shè)計(jì)的技術(shù)細(xì)節(jié)與實(shí)現(xiàn)方法，并附以簡(jiǎn)化的代碼示例。

  • FPGA在計(jì)算復(fù)雜的醫(yī)療成像設(shè)備中的應(yīng)用

    隨著醫(yī)療科技的飛速發(fā)展，醫(yī)療成像設(shè)備在醫(yī)學(xué)診斷和治療中扮演著至關(guān)重要的角色。從傳統(tǒng)的X射線(xiàn)到先進(jìn)的計(jì)算機(jī)斷層掃描(CT)、磁共振成像(MRI)乃至四維成像(4D成像)，這些成像技術(shù)為醫(yī)生提供了詳盡、準(zhǔn)確的患者體內(nèi)信息。然而，這些技術(shù)的實(shí)現(xiàn)和優(yōu)化離不開(kāi)強(qiáng)大的計(jì)算支持，其中現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)作為一種高度靈活且強(qiáng)大的硬件平臺(tái)，在計(jì)算復(fù)雜的醫(yī)療成像設(shè)備中發(fā)揮著越來(lái)越重要的作用。

  • 一款平臺(tái)，雙芯選擇，米爾XyLinko(芯聯(lián)酷)FPGA開(kāi)發(fā)平臺(tái)

    隨著物聯(lián)網(wǎng)（IoT）、工業(yè)自動(dòng)化、醫(yī)療設(shè)備等領(lǐng)域?qū)η度胧较到y(tǒng)的需求不斷增加。嵌入式核心板（SOM）作為嵌入式系統(tǒng)的核心組件，其市場(chǎng)需求也隨之增長(zhǎng)。在快速發(fā)展的同時(shí)，也面臨一定的挑戰(zhàn)：如進(jìn)口芯片供應(yīng)鏈不可控、單一平臺(tái)受地域政策限制、多平臺(tái)產(chǎn)品開(kāi)發(fā)周期長(zhǎng)、開(kāi)發(fā)難度高等問(wèn)題，米爾電子設(shè)計(jì)開(kāi)發(fā)了XyLinko（芯聯(lián)酷）FPGA 開(kāi)發(fā)平臺(tái)，支持一款平臺(tái)，雙芯設(shè)計(jì)，支持同款底板可換國(guó)產(chǎn)和進(jìn)口芯片，推出MYIR 7A100T和PG2L100H核心板，解決客戶(hù)對(duì)國(guó)內(nèi)國(guó)際市場(chǎng)的不同需求。

  • 貿(mào)澤開(kāi)售適用于汽車(chē)和EV應(yīng)用的Texas Instruments DLP2021-Q1 DLP數(shù)字微鏡器件

    2024年9月11日 – 專(zhuān)注于引入新品的全球電子元器件和工業(yè)自動(dòng)化產(chǎn)品授權(quán)代理商貿(mào)澤電子 (Mouser Electronics) 即日起開(kāi)售Texas Instruments全新的DLP2021-Q1汽車(chē)用0.2英寸DLP?數(shù)字微鏡器件 (DMD)。DLP2021-Q1設(shè)計(jì)用于汽車(chē)外部照明控制和顯示應(yīng)用，包括適用于汽車(chē)和EV應(yīng)用、帶有動(dòng)畫(huà)和動(dòng)態(tài)內(nèi)容的全彩地面投影。

  • 干貨滿(mǎn)滿(mǎn)！FPGA硬核和軟核處理器的區(qū)別

    FPGA的世界里，"核"如同心臟，驅(qū)動(dòng)著數(shù)字系統(tǒng)的運(yùn)作，它涵蓋了內(nèi)存調(diào)度、中斷管理等關(guān)鍵功能，由邏輯門(mén)與觸發(fā)器交織而成。IP核，即知識(shí)產(chǎn)權(quán)豐富的可重用模塊，有著三種形態(tài)：軟核、硬核與固核，各自承載著獨(dú)特的特性與應(yīng)用場(chǎng)景。

  • 數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享系列文章(第四部分)：將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

    本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC IP來(lái)在FPGA上開(kāi)發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。

  • 數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享(第三部分)：將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿(mǎn)挑戰(zhàn)的任務(wù)!

    本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC IP來(lái)在FPGA上開(kāi)發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。

  • FPGA圖像處理實(shí)戰(zhàn)：圖像裁剪技術(shù)

    在圖像處理領(lǐng)域，圖像裁剪是一項(xiàng)基礎(chǔ)且關(guān)鍵的技術(shù)，它允許我們從原始圖像中裁剪出感興趣的區(qū)域，同時(shí)丟棄不相關(guān)的部分。這種技術(shù)在人臉識(shí)別、目標(biāo)跟蹤、圖像分割等多種應(yīng)用場(chǎng)景中發(fā)揮著重要作用。隨著FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）技術(shù)的快速發(fā)展，將圖像裁剪算法部署到FPGA上已成為提高處理速度和降低功耗的有效手段。本文將詳細(xì)介紹FPGA圖像處理中的圖像裁剪技術(shù)，并給出具體的代碼實(shí)現(xiàn)。

  • FPGA中的圖像平移技術(shù)

    在圖像處理領(lǐng)域，圖像平移是一種基本的幾何變換操作，它能夠?qū)D像中的所有像素在二維平面上按照指定的方向和距離進(jìn)行移動(dòng)。這種操作不改變圖像的形狀或大小，但會(huì)顯著影響圖像在坐標(biāo)系中的位置。隨著FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）技術(shù)的快速發(fā)展，將圖像平移算法部署到FPGA上已成為提高圖像處理速度和效率的重要手段。本文將詳細(xì)介紹FPGA圖像處理中的圖像平移技術(shù)，并給出具體的代碼實(shí)現(xiàn)。

  • FPGA在圖像伽瑪校正中的應(yīng)用

    隨著數(shù)字圖像處理技術(shù)的不斷發(fā)展，圖像質(zhì)量?jī)?yōu)化成為了一個(gè)重要的研究方向。在圖像處理中，伽瑪（Gamma）校正是一種廣泛應(yīng)用的技術(shù)，用于調(diào)整圖像的亮度和對(duì)比度，以改善圖像質(zhì)量，使之更符合人眼的視覺(jué)感知。特別是在FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）平臺(tái)上實(shí)現(xiàn)伽瑪校正，由于其高并行性和靈活性，成為了圖像處理領(lǐng)域的一個(gè)熱點(diǎn)話(huà)題。

  • FPGA圖像之圖像對(duì)數(shù)變換

    在圖像處理領(lǐng)域，對(duì)數(shù)變換是一種非常實(shí)用的非線(xiàn)性變換方法，它能夠有效提升圖像暗區(qū)域的細(xì)節(jié)，同時(shí)壓縮亮區(qū)域，增強(qiáng)圖像的整體對(duì)比度。本文將深入探討對(duì)數(shù)變換在FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）平臺(tái)上的實(shí)現(xiàn)方法，并提供具體的代碼示例。

  • FPGA如何實(shí)現(xiàn)圖像的飽和度調(diào)節(jié)

    在圖像處理中，飽和度（Saturation）是一個(gè)至關(guān)重要的參數(shù)，它決定了顏色的純凈度和鮮艷程度。飽和度調(diào)節(jié)不僅能夠增強(qiáng)圖像的視覺(jué)效果，還能在不同應(yīng)用場(chǎng)景下突出圖像的主題和氛圍。本文將深入探討在FPGA平臺(tái)上實(shí)現(xiàn)飽和度調(diào)節(jié)的方法，并提供相應(yīng)的代碼示例。

  • FPGA中Canny邊緣檢測(cè)算法，附代碼

    在圖像處理領(lǐng)域，邊緣檢測(cè)是識(shí)別圖像中對(duì)象邊界的重要技術(shù)。Canny邊緣檢測(cè)算法以其高效性和準(zhǔn)確性成為應(yīng)用最廣泛的邊緣檢測(cè)算法之一。本文將深入探討Canny算法在FPGA平臺(tái)上的實(shí)現(xiàn)方法，并附上關(guān)鍵代碼片段，展示如何通過(guò)FPGA的并行處理能力來(lái)加速邊緣檢測(cè)過(guò)程。

  • FPGA圖像處理實(shí)戰(zhàn)：圖像幀差法

    在圖像處理領(lǐng)域，幀差法（Frame Difference Method）是一種常用的運(yùn)動(dòng)目標(biāo)檢測(cè)方法，尤其適用于實(shí)時(shí)監(jiān)控系統(tǒng)中的運(yùn)動(dòng)目標(biāo)檢測(cè)和跟蹤。幀差法通過(guò)比較連續(xù)圖像幀之間的像素差異來(lái)識(shí)別運(yùn)動(dòng)區(qū)域，具有算法簡(jiǎn)單、計(jì)算量小、實(shí)時(shí)性好的優(yōu)點(diǎn)。本文將詳細(xì)介紹基于FPGA的圖像幀差法實(shí)現(xiàn)，包括其原理、實(shí)現(xiàn)步驟以及Verilog代碼示例。