FPGA

我要報(bào)錯(cuò)

FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。

基于FPGA的圖形點(diǎn)陣液晶顯示模塊的應(yīng)用設(shè)計(jì)

摘要：提出了一種基于FPGA和T6963C模塊來控制液晶顯示的實(shí)現(xiàn)方法。介紹了液晶顯示控制器T6963C的性能特點(diǎn)，給出了FPGA與液晶顯示屏WG240128B的硬件接口電路、軟件設(shè)計(jì)流程和液晶顯示程序。關(guān)鍵詞：FPGA；圖形液晶顯

數(shù)字電源
2010-09-12

FPGA 液晶顯示模塊應(yīng)用設(shè)計(jì) 圖形點(diǎn)陣
基于FPGA-SPARTAN芯片的CCD的硬件驅(qū)動(dòng)電路設(shè)計(jì)

基于FPGA-SPARTAN芯片的CCD的硬件驅(qū)動(dòng)電路設(shè)計(jì)

嵌入式教程
2010-09-12

硬件 CCD SPARTAN FPGA
基于FPGA和SMT387的SAR數(shù)據(jù)采集與存儲(chǔ)系統(tǒng)

為了解決現(xiàn)有的合成孔徑雷達(dá)SAR回波信號(hào)采集存儲(chǔ)系統(tǒng)不能同時(shí)滿足高采樣率、高采樣精度、高存儲(chǔ)速度、大存儲(chǔ)容量、脫機(jī)運(yùn)行的問題。該文提出了一種基于FPGA和DSP的SAR回波信號(hào)的采集與存儲(chǔ)系統(tǒng)。該系統(tǒng)采用專用于數(shù)據(jù)硬盤存儲(chǔ)的DSP功能模塊SMT387和ViTrex 4系列的FPGA器件XC4VFxl2設(shè)計(jì)。Virtex 4系列FPGA主要控制采集存儲(chǔ)系統(tǒng)的總體時(shí)序，采集回波信號(hào)的有效部分存入SATA硬盤，SMT387主要運(yùn)用紐曼-皮爾遜準(zhǔn)則的滑窗檢測(cè)算法檢測(cè)回波信號(hào)的具體位置，并計(jì)算出各種位置信息的具體參

數(shù)字電源
2010-09-10

數(shù)據(jù)采集 SAR SMT FPGA
MCS-51單片機(jī)與FPGA

1 單片機(jī)與FPGA的接口方式單片機(jī)與FPGA的接口方式一般有兩種，即總線方式與獨(dú)立方式。MCS-51單片機(jī)具有很強(qiáng)的外部總線擴(kuò)展能力，利用片外三總線結(jié)構(gòu)很容易實(shí)現(xiàn)單片機(jī)與FPGA的總線接口，而且單片機(jī)以總線方式與FPGA進(jìn)

單片機(jī)
2010-09-10

總線接口 MCS-51單片機(jī) BSP FPGA
基于FPGA的三相函數(shù)信號(hào)發(fā)生器設(shè)計(jì)

摘要：基于FPGA的三相函數(shù)信號(hào)發(fā)生器以DDS為核心，在Altera公司CycloneⅡ系列EP2C8T144C8上實(shí)現(xiàn)正弦波、方波、三角波和鋸齒波信號(hào)的產(chǎn)生，利用單片機(jī)PICl8F4550控制波形的頻率及相位差。同時(shí)單片機(jī)通過DAC0832控制波

電子設(shè)計(jì)自動(dòng)化
2010-09-10

正弦波函數(shù)信號(hào)發(fā)生器 BSP FPGA
2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

嵌入式軟件
2010-09-08

物聯(lián)網(wǎng) 嵌入式技術(shù) BSP FPGA
2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

嵌入式軟件
2010-09-08

物聯(lián)網(wǎng) 嵌入式技術(shù) BSP FPGA
基于FPGA的圖像調(diào)焦系統(tǒng)研究

摘要：采用基于圖像技術(shù)的自動(dòng)調(diào)焦方法，根據(jù)圖像分析出圖形的質(zhì)量，完成圖像預(yù)處理、清晰度判別，獲得當(dāng)前的成像狀況。通過控制電機(jī)，完成調(diào)焦操作。其中核心技術(shù)是分析圖像質(zhì)量評(píng)價(jià)函數(shù)。針對(duì)調(diào)焦算法計(jì)算量大、計(jì)

電子設(shè)計(jì)自動(dòng)化
2010-09-07

系統(tǒng)研究函數(shù) BSP FPGA
基于FPGA的彩色圖像增強(qiáng)系統(tǒng)

提高顯示器的視覺效果，提出增強(qiáng)比度擴(kuò)展和色飽和度兩種算法，來對(duì)彩色圖像進(jìn)行增強(qiáng)處理，為滿足視頻信號(hào)的實(shí)時(shí)性要求，應(yīng)用FPGA構(gòu)造高速圖像處理系統(tǒng)。實(shí)驗(yàn)結(jié)果表明，本方法能提高圖像的層次感，增強(qiáng)色彩飽和度，達(dá)到顯著提升視覺感受的效果。

電子設(shè)計(jì)自動(dòng)化
2010-09-06

彩色圖像 RGB BSP FPGA
基于FPGA的65nm芯片的設(shè)計(jì)方案

　　隨著工藝技術(shù)向65nm以及更小尺寸的邁進(jìn)，出現(xiàn)了兩類關(guān)鍵的開發(fā)問題：待機(jī)功耗和開發(fā)成本。這兩個(gè)問題在每一新的工藝節(jié)點(diǎn)上都非常突出，現(xiàn)在已經(jīng)成為設(shè)計(jì)團(tuán)隊(duì)面臨的主要問題。在設(shè)計(jì)方法上從專用集成電路(ASIC)和

數(shù)字電源
2010-09-05

芯片待機(jī)功耗 65NM FPGA
基于FPGA的65nm芯片的設(shè)計(jì)方案

基于FPGA的65nm芯片的設(shè)計(jì)方案

嵌入式教程
2010-09-05

芯片待機(jī)功耗 65NM FPGA
FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

　　本文將介紹FPGA的功耗、流行的低功耗功能件以及影響功耗的用戶選擇方案，并探討近期的低功耗研究，以洞察高功率效率FPGA的未來趨勢(shì)?！　」牡慕M成部分　　FPGA的功耗由兩部分組成：動(dòng)態(tài)功耗和靜態(tài)功耗。信號(hào)給

數(shù)字電源
2010-09-05

器件芯片供電 FPGA
FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

嵌入式教程
2010-09-05

器件芯片供電 FPGA
基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

嵌入式教程
2010-09-05

仿真復(fù)用器 VHDL FPGA
用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

　　引言　　HDLC的ASIC芯片使用簡(jiǎn)易，功能針對(duì)性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己

數(shù)字電源
2010-09-05

控制 DSP實(shí)現(xiàn) HDLC FPGA
用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

嵌入式教程
2010-09-05

控制 DSP實(shí)現(xiàn) HDLC FPGA
基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

LatticeXP2器件包括基于查找表（LUT）的 FPGA以及非易失閃存單元（flexiFLASH）。LatticeXP2系列器件的LUT從5K到40K，分布是RAM從10K到83Kb，EBR SRAM從166Kb到885Kb，EBR SRAM區(qū)塊從9到48個(gè)，sysDSP從3個(gè)到8個(gè)，18x

數(shù)字電源
2010-09-04

電路圖評(píng)估板 LATTICE FPGA
基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

LatticeXP2器件包括基于查找表（LUT）的 FPGA以及非易失閃存單元（flexiFLASH）。LatticeXP2系列器件的LUT從5K到40K，分布是RAM從10K到83Kb，EBR SRAM從166Kb到885Kb，EBR SRAM區(qū)塊從9到48個(gè)，sysDSP從3個(gè)到8個(gè)，18x

數(shù)字電源
2010-09-04

電路圖評(píng)估板 LATTICE FPGA
基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

嵌入式教程
2010-09-04

電路圖評(píng)估板 LATTICE FPGA
基于ARM與FPGA的LCD控制器設(shè)計(jì)

基于ARM與FPGA的LCD控制器設(shè)計(jì)

嵌入式教程
2010-09-03

ARM 控制器設(shè)計(jì) LCD控制器 FPGA

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FPGA

基于FPGA的圖形點(diǎn)陣液晶顯示模塊的應(yīng)用設(shè)計(jì)

基于FPGA-SPARTAN芯片的CCD的硬件驅(qū)動(dòng)電路設(shè)計(jì)

基于FPGA和SMT387的SAR數(shù)據(jù)采集與存儲(chǔ)系統(tǒng)

MCS-51單片機(jī)與FPGA

基于FPGA的三相函數(shù)信號(hào)發(fā)生器設(shè)計(jì)

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

基于FPGA的圖像調(diào)焦系統(tǒng)研究

基于FPGA的彩色圖像增強(qiáng)系統(tǒng)

基于FPGA的65nm芯片的設(shè)計(jì)方案

基于FPGA的65nm芯片的設(shè)計(jì)方案

FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

基于ARM與FPGA的LCD控制器設(shè)計(jì)

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