FPGA
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基于FPGA的PCB測試機(jī)硬件電路設(shè)計(jì)
PCB 光板測試機(jī)基本的測試原理是歐姆定律，其測試方法是將待測試點(diǎn)間加一定的測試電壓，用譯碼電路選中PCB 板上待測試的兩點(diǎn)，獲得兩點(diǎn)間電阻值對應(yīng)的電壓信號，通過電壓比較電路，測試出兩點(diǎn)間的電阻或通斷情況。
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基于FPGA的多通道HDLC收發(fā)電路設(shè)計(jì)
HDLC(High Level Date Link Control)協(xié)議是通信領(lǐng)域中應(yīng)用最廣泛的協(xié)議之一，它是面向比特的高級數(shù)據(jù)鏈路控制規(guī)程，具有差錯檢測功能強(qiáng)大、高效和同步傳輸?shù)奶攸c(diǎn)。目前市場上有很多專用的HDLC芯片，但這些芯片大
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采用FPGA的SOPC技術(shù)研究了傳感器非線性軟件校正的實(shí)現(xiàn)
0 引 言 現(xiàn)代測量系統(tǒng)中，傳感器的工作性能直接影響整個系統(tǒng)。由于受外界因素的影響，傳感器大多具有非線性特性，致使測量儀表或系統(tǒng)的輸入與輸出之間不能保證很好的線性關(guān)系。除了采取硬件補(bǔ)償電路外，對于軟件補(bǔ)
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基于TMS320C6713和FPGA的數(shù)字電源控制模塊設(shè)計(jì)
1、引言 重離子加速器冷卻儲存環(huán)（HIRFL—CSR）是國家“九五”期間重點(diǎn)工程，主要是由主環(huán)CSRm和實(shí)驗(yàn)環(huán)CSRe組成，可以實(shí)現(xiàn)對重離子的同步加速、冷卻和儲存。磁鐵與電源組成加速器的磁場系統(tǒng)，用來產(chǎn)生約束磁場。
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基于DSP和FPGA的三相異步電機(jī)矢量伺服系統(tǒng)
本文所研究的交流伺服系統(tǒng)，充分利用DSP和FPGA的外圍電路和控制接口，簡化了硬件設(shè)計(jì)，同時在軟件設(shè)計(jì)中采用模塊化方法方便復(fù)雜程序的編寫。實(shí)驗(yàn)結(jié)果顯示該系統(tǒng)具有良好的控制性能。隨著工業(yè)生產(chǎn)中不斷增長的高精度、高可靠性的需求，交流伺服系統(tǒng)的應(yīng)用將越來越廣泛。
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基于EP2SGX系列FPGA的PCI接口設(shè)計(jì)
0 引 言 在現(xiàn)代雷達(dá)數(shù)據(jù)處理系統(tǒng)和其他應(yīng)用系統(tǒng)中，傳統(tǒng)的ISA、EISA等總線已逐漸無法適應(yīng)高速數(shù)據(jù)傳輸?shù)囊?。而PCI局部總線以其高性能、低成本、使用方便和適應(yīng)性等優(yōu)點(diǎn)成為大多數(shù)系統(tǒng)的主流總線。其中常用的
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Altera Stratix IVFPGA助推XDI dbX分析平臺
Altera公司 宣布，XtremeData有限公司下一代dbX系列數(shù)據(jù)庫平臺設(shè)計(jì)采用了高性能Stratix® IV FPGA，該系列專門用于對大型數(shù)據(jù)庫進(jìn)行全面分析和研究。 dbX是含有分析系統(tǒng)所有組件的全集成平臺，包括，存儲、計(jì)算
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FPGA與ADSP TS201的總線接口設(shè)計(jì)
在雷達(dá)信號處理、數(shù)字圖像處理等領(lǐng)域中，信號處理的實(shí)時性至關(guān)重要。由于FPGA芯片在大數(shù)據(jù)量的底層算法處理上的優(yōu)勢及DSP芯片在復(fù)雜算法處理上的優(yōu)勢，DSP+FPGA的實(shí)時信號處理系統(tǒng)的應(yīng)用越來越廣泛。ADI公司的
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基于AD9852的基準(zhǔn)源設(shè)計(jì)
0 引 言 直接數(shù)字頻率合成(DD6)是一種以固定的精確時鐘源為基準(zhǔn)，利用數(shù)字處理模塊產(chǎn)生頻率和相位均可調(diào)的輸出信號的技術(shù)。隨著超大規(guī)模集成電路和微電子技術(shù)的發(fā)展，現(xiàn)代高性能、高集成度和小體積的DDS產(chǎn)品正
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Altera Stratix IVFPGA助推XDI dbX分析平臺
Altera Stratix IVFPGA助推XDI dbX分析平臺
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Jointwave展示H.264 IP Core for Xilinx FPGA方案
Jointwave公司是全球領(lǐng)先的FPGA/ASIC 多媒體IP Core 設(shè)計(jì)服務(wù)公司和日本最大FPGA/AISC IP分銷商。SPINNAKER SYSTEMS 聯(lián)合推廣 H.264 for FPGA/ASIC IP on Altera Cyclone III FPGA平臺實(shí)時演示在InterBEE2009 (Alter
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采用FPGA的SOPC技術(shù)研究了傳感器非線性軟件校正的實(shí)現(xiàn)
采用FPGA的SOPC技術(shù)研究了傳感器非線性軟件校正的實(shí)現(xiàn)
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基于TMS320C6713和FPGA的數(shù)字電源控制模塊設(shè)計(jì)
1、引言 重離子加速器冷卻儲存環(huán)（HIRFL—CSR）是國家“九五”期間重點(diǎn)工程，主要是由主環(huán)CSRm和實(shí)驗(yàn)環(huán)CSRe組成，可以實(shí)現(xiàn)對重離子的同步加速、冷卻和儲存。磁鐵與電源組成加速器的磁場系統(tǒng)，用來產(chǎn)生約束磁場。
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基于DSP和FPGA的三相異步電機(jī)矢量伺服系統(tǒng)
本文所研究的交流伺服系統(tǒng)，充分利用DSP和FPGA的外圍電路和控制接口，簡化了硬件設(shè)計(jì)，同時在軟件設(shè)計(jì)中采用模塊化方法方便復(fù)雜程序的編寫。實(shí)驗(yàn)結(jié)果顯示該系統(tǒng)具有良好的控制性能。隨著工業(yè)生產(chǎn)中不斷增長的高精度、高可靠性的需求，交流伺服系統(tǒng)的應(yīng)用將越來越廣泛。
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基于FPGA雷達(dá)成像方位脈沖壓縮系統(tǒng)的設(shè)計(jì)
合成孔徑雷達(dá)成像算法中較為成熟和應(yīng)用廣泛的算法主要有距離-多普勒(R-D)算法和線性調(diào)頻變標(biāo)(CS)算法。R-D算法復(fù)雜度相對較低，運(yùn)算比較簡單，雖然其成像質(zhì)量并不高，但是相比對穩(wěn)定性、存儲空間、功耗與實(shí)時性
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基于CPCI總線的通用FPGA信號處理板的設(shè)計(jì)
隨著雷達(dá)信號處理技術(shù)的不斷發(fā)展以及現(xiàn)代國防對雷達(dá)技術(shù)的需求，系統(tǒng)對雷達(dá)信號處理的要求也越來越高，需要實(shí)時處理更加龐大的數(shù)據(jù)。先進(jìn)的雷達(dá)信號處理設(shè)備不僅要求性能高、功能多樣化，而且要求信號處理設(shè)備
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基于CPCI總線的通用FPGA信號處理板的設(shè)計(jì)
隨著雷達(dá)信號處理技術(shù)的不斷發(fā)展以及現(xiàn)代國防對雷達(dá)技術(shù)的需求，系統(tǒng)對雷達(dá)信號處理的要求也越來越高，需要實(shí)時處理更加龐大的數(shù)據(jù)。先進(jìn)的雷達(dá)信號處理設(shè)備不僅要求性能高、功能多樣化，而且要求信號處理設(shè)備
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基于FPGA的遠(yuǎn)程圖像采集系統(tǒng)設(shè)計(jì)
引言 圖像信息的獲取和傳輸是圖像處理系統(tǒng)的重要組成部分，直接影響圖像處理系統(tǒng)的性能。圖像信息的采集包括對圖像數(shù)據(jù)、各種附帶參數(shù)信息以及狀態(tài)控制信號的采集，一般圖像信號和狀態(tài)參數(shù)信號以及控制信號是獨(dú)立
