FPGA
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基于FPGA玻璃缺陷圖像采集處理系統(tǒng)
在進(jìn)行圖像采集過程中，重點需要解決采集系統(tǒng)的實時性問題。而這里選用的多線陣CCD拼接圖像的采集方法勢必導(dǎo)致在低級算法階段會產(chǎn)生極大的數(shù)據(jù)流，應(yīng)用一個高速的嵌入式處理模塊則能很好地完成圖像處理的低級算法部分。在此分析了玻璃缺陷采集處理系統(tǒng)的工作過程，對系統(tǒng)內(nèi)存控制做了詳細(xì)的描述，并在FPGA內(nèi)實現(xiàn)了圖像的低級處理，從而使計算機(jī)從低級處理的大量數(shù)據(jù)中解脫出來。
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基于FPGA嵌入式的多比特自相關(guān)器設(shè)計
該設(shè)計利用FPGA的嵌入式軟核NiosⅡ處理器，通過嵌入式操作系統(tǒng)μC／OS-Ⅱ，實現(xiàn)了在FPGA內(nèi)的自相關(guān)計算器；利用FPGA強(qiáng)大的并行運算功能和自帶存儲器實現(xiàn)的“乒乓”RAM，通過軟核NiosⅡ輸出控制字實時切換調(diào)用兩個“乒乓”RAM的存儲和讀取功能，使之同時完成對采集數(shù)據(jù)的緩沖存儲和向乘法器提供計算數(shù)據(jù)的功能，使芯片的整個數(shù)字處理鏈路連續(xù)化。另外，采用多比特進(jìn)行自相關(guān)運算較之于現(xiàn)在天文臺使用的1 b量化自相關(guān)器，能有效地提高SNR退化比。
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基于FPGA嵌入式的多比特自相關(guān)器設(shè)計
基于FPGA嵌入式的多比特自相關(guān)器設(shè)計
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S2C公司ASIC原型設(shè)計工具獲炬力半導(dǎo)體采用
S2C公司近日宣布，S2C公司的ASIC原型的硬件和軟件正式被炬力半導(dǎo)體公司采用在其芯片設(shè)計流程中。炬力使用S2C的Virtex-5 TAI Logic Module，一種基于FPGA的原型系統(tǒng)，以及TAI Player Pro軟件加速SoC設(shè)計創(chuàng)造，驗證及在
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基于FPGA的改進(jìn)型分組交織器的設(shè)計與實現(xiàn)
Turbo碼是由法國人Berrou于1993年提出的一種性能優(yōu)越的信道編碼方案[1]，其應(yīng)用已逐步推廣到衛(wèi)星通信、移動通信和計算機(jī)通信等領(lǐng)域。交織器作為Turbo碼編碼器中的重要組成部分，在Turbo碼的性能中起著至關(guān)重要
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Altera Cyclone IV FPGA，助力低成本市場應(yīng)用
市場變化正在推動著高帶寬的進(jìn)一步發(fā)展，尤其在消費類視頻顯示領(lǐng)域。一方面，新的技術(shù)不斷涌現(xiàn)，高清晰度視頻、3D立體視頻不僅需要更高的帶寬，同時，成本也變得更加敏感。在過去的兩年里，液晶電視，高清晰度液晶顯
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Cyclone IV FPGA（Altera）
Altera拓展其成功的CycloneFPGA系列并延續(xù)其收發(fā)器技術(shù)領(lǐng)先優(yōu)勢，于今天發(fā)布Cyclone IV FPGA新系列。在移動視頻、語音和數(shù)據(jù)訪問以及高質(zhì)量3D圖像對低成本帶寬需求的推動下，Cyclone IV FPGA系列增加了對主流串行協(xié)
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炬力半導(dǎo)體正式采用S2C ASIC原型設(shè)計工具
關(guān)鍵字: 炬力半導(dǎo)體 S2C ASIC Virtex-5 TAI Logic Module S2C公司宣布， S2C公司的ASIC原型的硬件和軟件正式被炬力半導(dǎo)體公司采用在其芯片設(shè)計流程中。炬力使用S2C的Virtex-5 TAI Logic Module，一種基于FPGA的原
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Cyclone IV FPGA（Altera）
Altera拓展其成功的CycloneFPGA系列并延續(xù)其收發(fā)器技術(shù)領(lǐng)先優(yōu)勢，于今天發(fā)布Cyclone IV FPGA新系列。在移動視頻、語音和數(shù)據(jù)訪問以及高質(zhì)量3D圖像對低成本帶寬需求的推動下，Cyclone IV FPGA系列增加了對主流串行協(xié)
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基于FPGA的多通道串行A/D轉(zhuǎn)換器的控制器設(shè)計
在低成本、多通道數(shù)據(jù)采集系統(tǒng)中，串行接口A／D轉(zhuǎn)換器得到了廣泛的應(yīng)用，但是通道的輪換以及串行數(shù)據(jù)的傳輸會降低數(shù)據(jù)采集的速度和CPU的工作效率。以ADS7844為例介紹基于FPGA和VHDI。語言的A／D控制器設(shè)計方法，并通過計算機(jī)時序仿真結(jié)果驗證了該控制器的正確性。該控制器具有輸入通道自動轉(zhuǎn)換、數(shù)據(jù)并行輸出等特點，提高了采集速度和CPU的工作效率。
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ARM首席技術(shù)官：功耗問題下的“硅黑暗時代”（圖）
若沒有進(jìn)一步創(chuàng)新，設(shè)計師們將有可能在2020年迎來“黑暗”的硅世紀(jì)。能耗無法支撐設(shè)計出的高密度芯片。ARM公司首席技術(shù)官Mike Muller在主要討論FPGA和上網(wǎng)本未來的ARM年度技術(shù)大會上這么警告說。 他在演講中說，10年
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基于FPGA的多通道串行A/D轉(zhuǎn)換器的控制器設(shè)計
基于FPGA的多通道串行A/D轉(zhuǎn)換器的控制器設(shè)計
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基于FPGA的高速時鐘數(shù)據(jù)恢復(fù)電路的實現(xiàn)
0 引言 時鐘數(shù)據(jù)恢復(fù)電路是高速收發(fā)器的核心模塊，而高速收發(fā)器是通信系統(tǒng)中的關(guān)鍵部分。隨著光纖在通信中的應(yīng)用，信道可以承載的通信速率已經(jīng)可以達(dá)到GHz，從而使得接收端的接收速率成為限制通信速率的主要瓶頸
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基于ARM+FPGA的真空凍干控制系統(tǒng)設(shè)計
0 引言 冷凍干燥技術(shù)自1980年代在我國興起以來已取得長足發(fā)展，并已廣泛應(yīng)用于食品、低溫和真空等科學(xué)領(lǐng)域，基于一些食品和藥品加工行業(yè)的工藝需要，真空冷凍干燥技術(shù)需要迅速應(yīng)用與推廣?？刂葡到y(tǒng)對物料的加工
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基于FPGA的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計
針對大地電磁探測系統(tǒng)的特點,設(shè)計了以FPGA為核心處理器的多通道高分辨率電磁數(shù)據(jù)采集系統(tǒng)，解決了五路24位ADC芯片ADS1255與ARM之間接口復(fù)雜、難以實現(xiàn)的問題。詳細(xì)介紹了FPGA邏輯設(shè)計的模塊劃分和具體實現(xiàn)。本方案外圍電路結(jié)構(gòu)簡單可靠，易于擴(kuò)展，實現(xiàn)了采集系統(tǒng)的高性能和高可靠性，特別適用于多通道高精度的數(shù)據(jù)采集系統(tǒng)。
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集成11.3-Gbps收發(fā)器的FPGA(Altera)
Altera公司 宣布，開始量產(chǎn)發(fā)售Stratix® IV GT EP4S100G2 FPGA，這是業(yè)界首款集成了11.3-Gbps收發(fā)器的FPGA。Stratix IV GT FPGA是目前唯一滿足100G以太網(wǎng)(GbE)和100G光傳送網(wǎng)(OTN)下一代成幀器、MAC、橋接和交換
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基于虛擬圖像注入的目標(biāo)模擬器設(shè)計
提出了一種新的基于虛擬圖像注入的目標(biāo)模擬器的研究方法。該方法基于速度追蹤原理。模擬器從主控計算機(jī)獲得跟蹤設(shè)備及目標(biāo)的參數(shù)，用DSP產(chǎn)生圖像數(shù)據(jù)，F(xiàn)PGA控制圖像時序，最后通過Camera Link接口將目標(biāo)跟蹤的圖像數(shù)據(jù)發(fā)送出去，完成對目標(biāo)捕獲及跟蹤的模擬訓(xùn)練過程。給出了軟、硬件實現(xiàn)的方案和結(jié)構(gòu)。跟蹤捕獲過程可以達(dá)到目標(biāo)場景的全景性和實時性，能夠滿足光電跟瞄設(shè)備的運行維護(hù)與操作訓(xùn)練要求。
