FPGA
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基于FPGA內(nèi)部的FIFO設計
在FPGA設計中，內(nèi)部的FIFO設計是 個不可或缺的內(nèi)容，其設計的質(zhì)師會直接影響FPGA的邏輯容量和時序。在Xilinx中的某些高端器件是內(nèi)置的FIFO控制器，在coregen中可以直接產(chǎn)生這的硬FIFO控制器， 強烈建議能夠使用硬的H
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FPGA在高精度脈寬測量系統(tǒng)中的應用
測量領域以及儀表儀器領域中，對數(shù)字信號的測量主要便是對其信號脈沖寬度進行測量。目前使用最多的方式便是脈沖計數(shù)的方式，即通過高頻時鐘脈沖在待測信號的低電平處或者高電平處進行計數(shù)，然后依照
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FPGA器件配置模式
只有成功配置可編程邏輯器件FPGA之后，器件才能正常工作。Xilinx FPGA的配置有3種模式，分別為并行(SelectMap)、串行(Serial)和邊界掃描(Boundary Scan)模式。當然Virtex-5和Spartan-3E／3A的器件有更多的配置模式，
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FPGA中增加SPI和BPI配置模式
在Xilinx新一代的FPGA中增加了SPI和BPI配置模式，好處是成本低、設計者選擇余地大及配置方便等優(yōu)點。例如，Spartan-3E器件支持多種Vendor(生產(chǎn)商)提供的SPI和BPIFlash產(chǎn)品。對于SPI Flash器件可以通過Xilinx的Cable-
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FPGA器件配置流程
Xilinx的FPGA器件配置流程共有4個階段，每個階段分別執(zhí)行不同的命令和操作。這4個階段分別為配置存儲器清除、初始化、裝入配置數(shù)據(jù)和啟動器件，下面以Spartan-3的加載為例說明這個過程。 (1)配置存儲器清除階段(如圖
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配置FPGA器件時的常見問題
在配置FPGA器件時的常見問題及其解決方法。 (1)當模式改變后，同時需要修改產(chǎn)生位流文件中的配置時鐘的屬性為CCLK或JTAGClock，否則無法配置。 (2)DONE狀態(tài)腳始終為低解決方法：檢查該引腳的負載是否太重，選擇合適的
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嵌入式多軸運動控制系統(tǒng)軟硬件實現(xiàn)方案
運動控制技術是推動新的技術革命和新的產(chǎn)業(yè)革命的關鍵技術，高速、高精度始終是運動控制技術追求的目標。運動控制技術能夠快速發(fā)展主要得益于計算機、高速數(shù)字處理器（DSP）、自動控制、網(wǎng)絡技術的發(fā)展，不僅應用于數(shù)控機床、工業(yè)機器人、輕工、紡織、化工、冶金等傳統(tǒng)行業(yè)，還在國防、航空航天等多個領域得到廣泛應用。
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一文讀懂嵌入式FPGA
嵌入式FPGA(eFPGA)是指將一個或多個FPGA以IP的形式嵌入ASIC，ASSP或SoC等芯片中。換句話說，eFPGA是一種數(shù)字可重構(gòu)結(jié)構(gòu)，由可編程互連中的可編程邏輯組成，通常表現(xiàn)為矩形陣列，數(shù)據(jù)輸入和輸出位于邊緣周圍。 eFPGA通常具有數(shù)百或數(shù)千個輸入和輸出，可連接到總線、數(shù)據(jù)路徑、控制路徑、GPIO、PHY或任何需要的器件。
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經(jīng)典款嵌入式智能小車的設計技巧，提供硬件選型
傳統(tǒng)智能小車，特別是嵌入式系統(tǒng)，一般都是基于單片機或者ARM的嵌入式系統(tǒng)，基本上都由軟件系統(tǒng)和硬件系統(tǒng)組成的，硬件系統(tǒng)方面，跟傳統(tǒng)的搭建硬件環(huán)境一樣，只能做相對裁剪和功能拓展，但是，本項目的課題是通過xilinx的FPGA開發(fā)板搭建嵌入式的硬件環(huán)境，從最小系統(tǒng)到IP核的添加，都是根據(jù)需要進行拓展的，實現(xiàn)一對一的拓展，不浪費資源，而且基于F
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如何用C語言描述AES256加密算法最高效？
高級加密標準 (AES) 已經(jīng)成為很多應用（諸如嵌入式系統(tǒng)中的應用等）中日漸流行的密碼規(guī)范。
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主流FPGA簡介
多個平臺中的每一個都針對特定的應用領域進行了優(yōu)化，將系統(tǒng)成本降到了最低。 (1) Spartan-3A平臺：針對I/O進行了優(yōu)化。 針對那些I/O數(shù)和性能比邏輯密度更重要的應用，特別適用于橋接、差分信號和存儲器接口這些需要
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非易失性FPGA
非易失陛安全FPGA實現(xiàn)最高系統(tǒng)集成，Spartan-3AN平臺針對要求非易矢性系統(tǒng)集成、安全性或大型用戶Flash的應用. (1) SRAM FPGA和Flash技術突破性的強強結(jié)合。 (2) 無與倫比的Flash可靠性,加上此前只自SRAM FPGA才具備
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數(shù)字信號處理FPGA Spartan
針對要求集成DSPMAC和擴展存儲器的應用. (1)具備多達53 K個邏輯單元和強大的片上存儲器，可支持高密度設計。 (2)使用成本優(yōu)化的集成DSP48A Slice，不到30美元即可實現(xiàn)超過20 GMACS的DSP性能。 (3)要求低成本FPGA設計
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全球速度最快的FPGA
日前，Achronix 半導體公司宣布全球速度最快的 FPGA 現(xiàn)已開始供貨。Speedster 系列的首款產(chǎn)品為 SPD60，該產(chǎn)品系列的速度可達 1.5 GHz，性能比現(xiàn)有 FPGA 提高了 3 倍。 參加 Achronix 早期試用合作的客戶已經(jīng)利用 S
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FPGA未來發(fā)展道路如何走？
多種趨勢正在將FPGA推向兩條截然不同的發(fā)展道路。
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一文讀懂嵌入式FPGA
嵌入式FPGA(eFPGA)是指將一個或多個FPGA以IP的形式嵌入ASIC，ASSP或SoC等芯片中?！ Q句話說，eFPGA是一種數(shù)字可重構(gòu)結(jié)構(gòu)，由可編程互連中的可編程邏輯組成，通常表現(xiàn)為
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DDS的FPGA實現(xiàn)設計
根據(jù)圖1，并假定相位控制字為0，這時DDS的核心部分相位累加器的FPGA的設計可分為如下幾個模塊：相位累加器SUM99、相位寄存器REG1、正弦查找表ROM和輸出數(shù)據(jù)寄存器REG2，其內(nèi)部組成框圖如圖 2所示。圖中，輸入信號有時
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FPGA與多核CPU使嵌入式設計更靈活
隨著嵌入式器件在過去數(shù)十年來的爆炸性成長，使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新，但傳統(tǒng)嵌入式系統(tǒng)的設計方法卻少有進步，并逐漸變成一種障礙。有鑒于新標準與協(xié)議的快速
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如何為 FPGA 供電尋找最佳解決方案
為 FPGA 應用設計優(yōu)秀電源管理解決方案不是一項簡單的任務，相關的技術討論有很多很多。今天小編要為大家分享的內(nèi)容『FPGA 的電源管理』主要有兩個目的——
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FPGA數(shù)據(jù)采集電路仿真圖
圖1 是FPGA數(shù)據(jù)采集電路VHDL程序設計仿真圖。請讀者自己對照程序進行仿真分析。 圖1 FPGA數(shù)據(jù)采集電路仿真圖 歡迎轉(zhuǎn)載,信息來自維庫電子市場網(wǎng)（www.dzsc.com）來源:ks991次
